[发明专利]一种大马士革的集成方法有效
| 申请号: | 201110272665.4 | 申请日: | 2011-09-15 |
| 公开(公告)号: | CN102446824B | 公开(公告)日: | 2014-02-05 |
| 发明(设计)人: | 陈玉文;李磊;胡友存;张亮;姬峰 | 申请(专利权)人: | 上海华力微电子有限公司 |
| 主分类号: | H01L21/768 | 分类号: | H01L21/768 |
| 代理公司: | 上海新天专利代理有限公司 31213 | 代理人: | 王敏杰 |
| 地址: | 201210 上海市浦*** | 国省代码: | 上海;31 |
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| 摘要: | 本发明公开了一种大马士革的集成方法,其所形成的通孔和沟槽图案可以得到很好地控制,并且消除了由于相邻的沟槽之间和相邻通孔之间由于出现互连而带来的电流泄漏情况的发生,工艺过程简单,易控制。 | ||
| 搜索关键词: | 一种 大马士革 集成 方法 | ||
【主权项】:
一种大马士革的集成方法,其特征在于,包括以下的步骤:步骤S1:在一层间介质层中形成有金属互连线,并在层间介质层上从下至上依次淀积有通孔刻蚀阻挡层、通孔低介电常数层、通孔低介电常数保护层、通孔金属硬掩膜层以及通孔金属硬掩膜低介电常数保护层;步骤S2:在通孔金属硬掩膜低介电常数保护层之上涂覆一层光刻胶,并进行光刻工艺,形成位于光刻胶中的开口;步骤S3:通过开口依次刻蚀通孔金属硬掩膜低介电常数保护层以及通孔金属硬掩膜层,刻蚀终止于通孔低介电常数保护层,形成位于通孔金属硬掩膜低介电常数保护层中的通孔以及通孔金属硬掩膜层中的通孔,并去除光刻胶层;步骤S4:通过通孔金属硬掩膜层,依次刻蚀通孔低介电常数保护层、通孔低介电常数层和通孔刻蚀阻挡层,分别形成在竖直方向上位于层间介质层中的金属互连线上方的通孔结构,且上述的通孔金属硬掩膜低介电常数保护层在制备所述通孔结构的刻蚀工艺中被完全去除;步骤S5:在通孔金属硬掩膜层之上以及通孔结构的侧壁和底部沉积金属阻挡层和铜籽晶层,金属阻挡层和铜籽晶层与金属互连线相接触,并采用电化学镀ECP工艺生长金属铜;步骤S6:采用化学机械研磨法将金属铜抛光至通孔低介电常数层,形成位于抛光后的通孔低介电常数层和通孔刻蚀阻挡层中的铜互连线;步骤S7:在抛光后的包含有铜互连线的通孔低介电常数层上从下至上依次淀积沟槽刻蚀阻挡层、沟槽低介电常数层、沟槽低介电常数保护层、沟槽金属硬掩膜层以及沟槽金属硬掩膜低介电常数保护层;步骤S8:在沟槽金属硬掩膜低介电常数保护层之上采用旋涂法涂覆一层第二光刻胶层,并进行光刻工艺,形成与后续步骤中所需的沟槽结构相应的开口;步骤S9:通过步骤S8中形成的开口依次刻蚀沟槽金属硬掩膜低介电常数保护层以及沟槽金属硬掩膜层,刻蚀停止于沟槽低介电常数保护层,形成位于沟槽金属硬掩膜低介电常数保护层中沟槽以及沟槽金属硬掩膜层中的沟槽,并去除第二光刻胶层;步骤S10:通过沟槽金属硬掩膜层,依次刻蚀沟槽低介电常数保护层、沟槽低介电常数层和沟槽刻蚀阻挡层,形成沟槽结构,且上述的沟槽金属硬掩膜低介 电常数保护层在制备所述沟槽结构的刻蚀工艺中被完全去除;步骤S11:在沟槽金属硬掩膜层之上以及沟槽结构的侧壁和底部沉积第二金属阻挡层和第二铜籽晶层,并采用电化学镀ECP工艺生长金属铜;步骤S12:采用化学机械研磨法将金属铜抛光至沟槽低介电常数层,形成位于抛光后的沟槽低介电常数层和沟槽刻蚀阻挡层中的铜互连线。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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