[发明专利]防止延迟锁相环错误锁定的方法及其系统有效
| 申请号： | 201110079890.6 | 申请日： | 2011-03-31 |
| 公开（公告）号： | CN102148616A | 公开（公告）日： | 2011-08-10 |
| 发明（设计）人： | 亚历山大;刘天志 | 申请（专利权）人： | 山东华芯半导体有限公司 |
| 主分类号： | H03L7/08 | 分类号： | H03L7/08 |
| 代理公司： | 西安智邦专利商标代理有限公司 61211 | 代理人： | 徐平;王少文 |
| 地址： | 250101 山东省济南市高*** | 国省代码： | 山东;37 |
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| 摘要： | 本发明提供了一种防止延迟锁相环错误锁定的方法及其系统。其方法包括以下步骤：1)延时持续增加阶段；2)微调阶段；其中，步骤1)具体分为1.1)输入时钟经输入时钟分频电路分频后，所得到的分频输入时钟分别输入控制逻辑电路的I鉴相器和II鉴相器；1.2)反馈时钟经反馈时钟分频电路进行差分分频后，得到两路差分反馈时钟，分别输入控制逻辑电路的I鉴相器和II鉴相器；1.3)I鉴相器和II鉴相器对分频输入时钟和两路差分反馈时钟进行采样、比较后，当I鉴相器和II鉴相器的输出发生从1到0或从0到1的翻转时，发出锁定信号。本发明可以有效防止在输入时钟发生抖动时出现的延迟锁相环错锁现象，控制逻辑简单，并且可以加速锁定过程。 | ||
| 搜索关键词： | 防止 延迟 锁相环 错误 锁定 方法 及其 系统 | ||
【主权项】：
一种防止延迟锁相环错误锁定的方法，其特征在于：该方法包括以下步骤：1)延时持续增加阶段：1.1)输入时钟经输入时钟分频电路分频后，所得到的分频输入时钟分别输入控制逻辑电路的I鉴相器和II鉴相器；1.2)反馈时钟经反馈时钟分频电路进行差分分频后，得到两路差分反馈时钟，分别输入控制逻辑电路的I鉴相器和II鉴相器；1.3)I鉴相器和II鉴相器对分频输入时钟和两路差分反馈时钟进行采样、比较后，当I鉴相器和II鉴相器的输出发生从1到0或从0到1的翻转时，发出锁定信号；2)微调阶段。
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