[发明专利]一种动态可配置的指令访问加速器无效
| 申请号： | 201010206659.4 | 申请日： | 2010-06-22 |
| 公开（公告）号： | CN102169428A | 公开（公告）日： | 2011-08-31 |
| 发明（设计）人： | 林锦麟;李兴仁;金荣伟;刘春晖 | 申请（专利权）人： | 上海盈方微电子有限公司 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 201203 上海市张江*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明提出一种动态可配置的指令访问加速器。动态可配置的指令访问加速器能够作为高速缓存的一个补充，在高速缓存和外部存储器之间增加一些指令缓冲区和预测单元，能够根据不同应用情况、内部总线特征和外部存储器控制器的接口特点，调整内部指令缓冲区大小，用以缩短高速缓存不命中时访问外部存储器的时钟周期，加快系统启动时间。 | ||
| 搜索关键词： | 一种 动态 配置 指令 访问 加速器 | ||
【主权项】：
一种动态可配置指令加速器，包括高速缓存总线接口、内部总线接口、控制逻辑、指令访问统计预测单元和至少一个可配置的指令缓冲区，其中高速缓存总线接口和CPU处理器对接，内部总线接口和外部存储器控制器对接，相互连接的控制逻辑、指令访问统计预测单元和可配置的指令缓冲区分别连接于高速缓存总线接口和内部总线接口之间，其特征在于：所述控制逻辑用于根据CPU处理器中高速缓存不命中时，依内部总线特点，向外部存储器控制器发出一定数目字节的指令，存储在内部可配置的指令缓冲区，同时向CPU处理器的高速缓存返回一行的指令。
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