[发明专利]数字PLL电路及通信装置无效
申请号: | 200980141717.5 | 申请日: | 2009-03-13 |
公开(公告)号: | CN102187579A | 公开(公告)日: | 2011-09-14 |
发明(设计)人: | 濑上史明;冈本好史 | 申请(专利权)人: | 松下电器产业株式会社 |
主分类号: | H03L7/087 | 分类号: | H03L7/087;H03L7/085 |
代理公司: | 中科专利商标代理有限责任公司 11021 | 代理人: | 汪惠民 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | 本发明提供一种数字PLL电路及通信装置。在输出具有以频率控制字(频率比率)对参考信号的频率进行了规定倍率后的频率的时钟信号的数字PLL电路中,RPA电路(101)逐次对具有小数成分的频率控制字(FCW)进行加法运算。该RPA电路(101)的输出被输入到微小相位误差生成器(107)。在该相位误差生成器(107)中,基于所述频率控制字(FCW)的逐次加法运算值的小数部,生成参考信号(REF)的实际的振幅值附近的多个阈值,并基于这些阈值,计算出所述参考信号(REF)的振幅值以及与该振幅值对应的参考信号REF的相位误差,从而计算出参考信号(REF)与输出时钟(CKV1)之间的微小相位误差。因此,即使在频率控制字包含小数成分的情况下,也能够以小面积、低功耗计算并修正参考信号与输出时钟之间的残留微小相位误差。 | ||
搜索关键词: | 数字 pll 电路 通信 装置 | ||
【主权项】:
一种数字PLL电路,其被输入参考信号,输出具有以由整数部和小数部构成的数值对该参考信号的频率进行了规定倍率后的频率的时钟信号,该数字PLL电路的特征在于,具备:控制振荡器,其被输入控制量,根据该输入的控制量,变更从所述数字PLL电路输出的时钟信号的频率;第一计数器,其对由所述控制振荡器变更了频率后的所述时钟信号进行计数;第二计数器,其根据基于来自所述控制振荡器的时钟信号对所述参考信号进行了重定时后的重定时信号,增加所述规定倍率;比较器,其比较所述第一计数器的计数值和所述第二计数器的计数值的整数部,输出两者之差作为整数部的相位误差;微小相位误差生成器,其基于所述第二计数器的计数值的小数部,生成所述参考信号的振幅值附近的多个阈值,基于该多个阈值来检测所述参考信号的振幅值,并且基于该检测出的振幅值,生成作为所述参考信号与来自所述控制振荡器的输出时钟信号之间的小数部的相位误差的微小相位误差信息;滤波部,其接收来自所述比较器的整数部的相位误差和来自所述微小相位误差生成器的作为小数部的相位误差的微小相位误差信息,使这两个相位误差的合计误差平滑化;和控制量生成器,其基于所述滤波部的输出,生成并输出对于所述振荡器的所述控制量。
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