[发明专利]布线电路基板的制造方法无效

专利信息
申请号: 200910004096.8 申请日: 2009-02-11
公开(公告)号: CN101511149A 公开(公告)日: 2009-08-19
发明(设计)人: 竹村敬史 申请(专利权)人: 日东电工株式会社
主分类号: H05K3/10 分类号: H05K3/10;G03F7/00
代理公司: 上海专利商标事务所有限公司 代理人: 张 鑫
地址: 日本*** 国省代码: 日本;JP
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摘要: 发明提供一种布线电路基板的制造方法,包括:准备包含金属支持层与绝缘层的2层基材的工序;利用光致抗蚀剂覆盖绝缘层的上表面、绝缘层及金属支持层的侧端面的覆盖工序;配置光掩模,使其将在上表面形成端部及导体层的部分遮光,将覆盖上表面的光致抗蚀剂从上方通过光掩模曝光的工序;将覆盖侧端面的光致抗蚀剂从下方曝光的工序;去除光致抗蚀剂的未曝光部分,将曝光部分形成为图案,形成镀敷抗蚀膜的工序;以及形成端部导体层与导体层的工序。
搜索关键词: 布线 路基 制造 方法
【主权项】:
1. 一种布线电路基板的制造方法,其特征在于,包括:准备在金属支持层上层叠了绝缘层的2层基材的工序;利用光致抗蚀剂覆盖所述绝缘层的上表面、所述绝缘层及所述金属支持层的侧端面的覆盖工序;配置光掩模使其将在所述绝缘层的上表面的形成端部及导体层的部分遮光,将覆盖所述绝缘层的上表面的所述光致抗蚀剂从上方通过所述光掩模曝光的工序;将覆盖所述绝缘层及所述金属支持层的侧端面的所述光致抗蚀剂从下方曝光的工序;去除所述光致抗蚀剂的未曝光部分,将曝光部分形成为图案,形成镀敷抗蚀膜的工序;在从所述镀敷抗蚀膜露出的所述绝缘层上,在所述绝缘层的上表面的端部形成端部导体层,同时在所述绝缘层的上表面形成所述导体层的工序;以及去除所述镀敷抗蚀膜的工序。
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