[发明专利]逻辑线路的点距分析方法无效
| 申请号： | 200610109843.0 | 申请日： | 2006-08-18 |
| 公开（公告）号： | CN101127054A | 公开（公告）日： | 2008-02-20 |
| 发明（设计）人： | 谢祥毅 | 申请（专利权）人： | 英业达股份有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 北京律诚同业知识产权代理有限公司 | 代理人： | 梁挥;徐金国 |
| 地址： | 中国台*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 本发明公开了一种逻辑线路的点距分析方法，利用一点距分析程序从一逻辑电路设定文件中，以字符串对比方式取得各测试点的坐标信息，再加载一电路区域划分规则以将所有测试点依其坐标指定至对应的电路区域中，接着通过一点距分析规则以分析同电路区域中各测试点之间的预测距离，最后标记不符规则的测试点与对应区域并记录形成一分析结果文件，汇入逻辑电路软件中。如此，使用者可迅速取得对逻辑电路中有关测试点设定点距的检测结果，大幅降低检测工作的时间，并减少人工对比时的疏忽失误。 | ||
| 搜索关键词： | 逻辑 线路 分析 方法 | ||
【主权项】：
1.一种逻辑线路的点距分析方法，可解析一逻辑电路设定文件直接产生可汇入一逻辑电路软件的测试点距离分析结果，其特征在于，该方法含下列步骤：(a)通过字符串对比方式查找该逻辑电路设定档案中数个测试点编码信息；(b)自该逻辑电路设定文件截取对应各该测试点编码信息的数个测试码坐标设定；(c)加载一电路区域划分规则，依照该坐标设定来指定各该测试点编码信息所对应的数个电路区域；(d)加载一点距分析规则，依序自各该电路区域分析区域中所包含各成对的该测试点坐标设定之间所对应的一预测距离值；以及(e)当任一预测距离值不符该点距分析规则时，标记该预测距离值所对应成对的该测试点坐标设定及对应该电路区域，并记录于一分析结果文件，以汇入该逻辑电路软件。
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