[发明专利]具有时钟转换的灵巧读卡器无效

专利信息
申请号: 99100894.4 申请日: 1999-01-20
公开(公告)号: CN1234566A 公开(公告)日: 1999-11-10
发明(设计)人: P·迪加贝 申请(专利权)人: 皇家菲利浦电子有限公司
主分类号: G06K19/07 分类号: G06K19/07;G07F7/02
代理公司: 中国专利代理(香港)有限公司 代理人: 王忠忠
地址: 荷兰艾*** 国省代码: 暂无信息
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摘要:
搜索关键词: 具有 时钟 转换 灵巧 读卡器
【说明书】:

发明涉及一灵巧读卡器,包括:

-连接器,该连接器与在插入该读卡器中的一灵巧卡的表面上的一集成电路进行电连接,该连接器中的称之为时钟端的至少一个端子将一时钟信号提供给所述集成电路;

-微控制器,用来与该集成电路交换数据并且管理它的电源和它的工作频率;

-插入在连接器和微控制器之间的接口模块,包括有第一振荡器,第一振荡器的输出端提供了具有转换频率的第一时钟信号,该接口模块还包括能够在该微控制器和集成电路之间交换数据的一处理单元;和

-第二振荡器,其输出端提供一第二时钟信号,第二时钟信号具有一一高于转换频率的工作频率,

该接口模块还包括有一转换装置,该转换装置根据自该微控制器所接收的一控制信号的值将第一时钟信号或第二时钟信号传送到该连接器的时钟端。

灵巧读卡器通常用于诸如便携式无线电话或电视信号译码器之类的用来接收和/或发送数据的装置中。在这种应用中,该灵巧卡包括用于该装置的操作所必要的数据,例如,一能够识别将该灵巧卡插入该读卡器中的用户的代码,并且该装置允许这个用户执行。当一卡被插入该读卡器中时,这二个单元在二个连续的工作模式中相互作用:在称为初始化模式的第一模式中,该系统还未工作。该读卡器首先检测灵巧卡的存在并随后将在该灵巧卡的表面上的集成电路置为标称工作状态,这就是说,特别提供一电压到那里或初始化数据通路从而使该集成电路可与该读卡器相通信。在称为永久模式的第二模式中,该集成电路配有一电压并且接收一具有工作频率的一时钟信号,并且该数据通路准备传送在该读卡器和集成电路之间的数据。在初始模式中,该集成电路必须接收一具有可不同于工作频率的频率的时钟信号。在该初始模式期间一具有低于工作频率(使用低于工作频率更为可取)的称为转换频率的频率的信号能降低该集成电路的能耗。这样一种选择特别有利于用来供给集成电路的电源是一电池作为其能源的例如便携式无线电话的应用场合。在初始模式的最后,接口模式将转换被提供至连接器的时钟端的信号。这种转换是由该转换装置来实现的,当它接收由控制信号的某些值所表示的命令时,用在永久模式期间构成该集成电路的时钟信号的第二时钟信号置换在初始模式期间构成该集成电路的时钟信号的时钟信号。

借助于由控制信号所控制的简单多路转换原理上可执行将一时钟信号转换成另一时钟信号。这种多路转换是异步的。如果第一和第二时钟信号分别是在无效和有效状态,则该时钟信号从一个转换到另一个时,所述转换将导致在信号被传送到该时钟端中出现一不希望的有效边沿,这种不希望的边沿既不是由第一时钟信号也是不是由第二时钟信号所产生的。这样一个不希望的有效边沿可能会对该集成电路的工作带来损害。为了防止这种缺点,可产生每一个均与该时钟信号中的一个相关联的二个授权信号并存贮在存贮触发器中,如果它的相关联信号是在有效状态中则由该控制信号所选择的时钟信号随后仅被转送到该时钟端。在两个周期中会使得从一时钟信号转换到另一时钟信号:在第一周期中,在存贮触发器中与被存贮的第一时钟信号相关联的授权信号是无效的,也就是说,在复位到零输入端它接收一有效信号,这个信号阻挠第二时钟信号向该时钟端的传送,在此之后,在第二周期中,在存贮触发器中与被存贮的第二时钟信号相关的授权信号是有效的,也就是说,在它的复位到零输入端它接收一能够使第二时钟信号传送到该时钟端的一无效信号。既使这样一种工作模式能够防止在信号传送到该时钟端中出现不希望的边沿,但是也会呈现另一个缺点。由于对于该触发器的无效即在该转换之前是有效,和对于该触发器的有效即在该转换之后必须无效这二个步骤是必须的,所以在该转换处理期间在由该控制信号所造成的所述信号的选择之后所立即出现的所希望的第二时钟信号的有效边沿可能会被忽略,这就不利于该集成电路的工作。

本发明的目的是通过建议一种在其中安置有转换电路和的一种灵巧读卡器,从而在一单一步骤中将一时钟信号转换为另一时钟信号而不会在该信号传送到时钟端中出现不希望的有效边沿来克服上述的缺点。

根据开头一段的灵巧读卡器,本发明的特征是该接口模块的转换装置包括一相位检测器,考虑到由所述有效状态所决定的利用该转换装置的控制信号,当第一和第二时钟信号具有准同时有效边沿时该相位检测器具有提供一适合于一有效状态的信号的输出。

该相位检测器可使该转换装置的任何转换与第一和第二时钟信号的有效边沿同时发生。同时发生的条件能够避免该转换所导致的在信号传送到该时钟端中出现的不希望的有效边沿。此外,当该转换发生在一单一步骤和准同时时,在该转换处理期间不会冒着忽略在该转换之后第二时钟信号的一有效边沿将出现一开始时间的危险。

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