[发明专利]控制对存储器访问的优先次序的装置和方法无效

专利信息
申请号: 97113818.4 申请日: 1997-06-23
公开(公告)号: CN1170202A 公开(公告)日: 1998-01-14
发明(设计)人: 赵灿东 申请(专利权)人: 三星电子株式会社
主分类号: G11B20/10 分类号: G11B20/10
代理公司: 柳沈知识产权律师事务所 代理人: 马莹
地址: 韩国*** 国省代码: 暂无信息
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摘要:
搜索关键词: 控制 存储器 访问 优先 次序 装置 方法
【说明书】:

发明涉及一种在光盘再现设备中的系统解码器,尤其涉及在数字视盘(或多用途盘)再现设备中控制对存储器访问的优先次序的装置和方法。

作为一种用于数字运动图像的记录媒体,数字视盘是能记录高质量的视频/音频数据的廉价多媒体记录媒体。这样的数字视盘能记录二小时以上容量的MPEG2(运动图像专家组2)数字图像。

参照图1,该图表示常规的数字视盘(DVD)再现设备,其中光盘电机160以恒速转动光盘100,具有光学头130的光学拾取器140读出在光盘100上的数字图像并将该数字图像变换成模拟高频(RF)信号。已变换的模拟信号被整形成脉冲以产生数据流性质的ESM(八至十六调制)数据。该ESM数据被加到系统解码器200和数字锁相环(以下称为“PLL”)300。系统解码器200执行对ESM数据的解调、纠错和解扰操作。存储器280包括第一和第二存储器(未示出)以便在系统解码器200执行上述操作的同时暂存从该系统解码器产生的数据。存储器280是DRAM(动态随机存取存储器)。微计算机500控制光盘再现系统的总体操作,并响应来自音频/视频(A/V)解码器600或ROM解码器950的数据传送起动信号而产生传送控制信号。数字PLL300包括相位比较器、压控振荡器和分频器,以产生与光盘再现信号同步的第一时钟。光盘驱动器控制器400根据由系统解码器200的同步检测器(未示出)提供的帧同步信号Sf并借助频率伺服和相位伺服来控制光盘转动的恒定线速和其他的光盘操作。音频/视频解码器600把系统解码器200的输出数据分离成音频数据和视频数据,以便把数据恢复成原始的音频和视频源数据。从音频/视频解码器600输出的已解调的音频和视频数据分别通过数模变换器800和NTSC编码器700被传送到扬声器970和监视器960。ROM(只读存储器)解码器950通常配备在主机(例如,个人计算机)中和按照主机的控制来操作。该ROM解码器950根据预定的接口方法把系统解码器200产生的数据传送给主机。

参照图2,在该图中表示图1中传统的数字视盘再现设备中的系统解码器200的详细框图。如图所示,从数字视盘100读出的ESM(八至十六调制)数据加到系统解码器。具体说,ESM数据用放大器114放大。连接到第一数据总线126的ESM调解器115对从放大器114输出的数据解调。连接到第一数据总线126的纠错电路116对从ESM解调器115输出的解调数据的错误进行纠正。从ESM解调器115和纠错电路116输出的数据存储到第一存储器(未示出)中。连接到第一数据总线126的第一存储器控制器121控制ESM解调器115和纠错电路116以对第一存储器访问。第一存储器刷新电路123按照第一存储器控制器121的控制来刷新第一存储器。解扰器117对从纠错电路116输出的已纠错数据解扰。内部SRAM(静态随机存取存储器)125存储解扰器117的已解扰数据。连接到第二数据总线127的数据写入器118把解扰器117输出的数据存储到第二存储器(未示出)。连接到第二数据总线127的微计算机存储器访问控制器119控制微计算机500以对第二存储器进行访问。连接到第二数据总线127的A/V解码器接口和DVD-ROM接口120是存储到音频/视频解码器600、ROM解码器950和第二存储器的已解扰数据的接口。第二存储器存储数据写入器118输出的数据。连接到第二数据总线127的第二存储器控制器122控制数据写入器118、微计算机存储器访问控制器119、及A/V解码器接口和DVD-ROM接口120以对第二存储器访问。第二存储器刷新电路124按照第二存储器控制器122的控制来刷新第二存储器。微计算机接口控制器111控制微计算机500和系统解码器200之间的接口操作。连接到第一和第二数据总线126和127的微计算机寄存器112接收微计算机接口控制器111输出的数据以存储用于控制系统解码器200的每一部件115-125的控制信号,并暂存由上述每一部件产生的状态信息以向微计算机500提供该状态信息。优先次序控制器113响应分别来自第一存储器刷新电路123、  ESM解调器115、纠错电路116、解扰器117、数据写入器118、微计算机存储器访问控制器119、A/V解码器接口和DVD-ROM接口120、以及第二存储器刷新电路124的访问请求信号而控制对存储器访问的优先次序。

从以上描述可以知道,现有技术的系统解码器200含有用于存储来自每一部件115-125的数据的三个存储器(即,第一和第二存储器以及内部SRAM),从而导致尺寸和制造成本的增加。因此,需要改进优先次序控制器113以便减少存储器的数目。

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