[发明专利]视频显示设备无效

专利信息
申请号: 96114546.3 申请日: 1996-11-06
公开(公告)号: CN1156302A 公开(公告)日: 1997-08-06
发明(设计)人: 成井良久;大内山干;八木容子 申请(专利权)人: 索尼公司
主分类号: G09G5/00 分类号: G09G5/00
代理公司: 中国专利代理(香港)有限公司 代理人: 董江雄,傅康
地址: 日本*** 国省代码: 暂无信息
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摘要:
搜索关键词: 视频 显示 设备
【说明书】:

发明涉及视频显示设备,具体地说涉及利用显示数据通道(DDC)系统将设备的特定信息传递到外部控制器的视频显示设备。

美国视频电子标准化协会(VESA)提出了DDC标准。按照DDC标准,具有与诸如监视器、键盘、鼠标等外设相连的计算机的计算机系统可以根据预定的协议,通过总线在计算机和外设之间交换设备特定的数据。

DDC系统定义几个等级。DDC1模式允许单向通信。DDC2模式允许双向通信。DDC2模式进一步分成两个等级。DDC2B模式仅允许通过计算机从外设读DDC数据。DDC2AB模式允许在计算机和外设之间读和写DDC数据。DDC2AB系统也称为ACCESS总线。

设备的特定信息,如设备模式或序号,以及操作信息,如垂直和水平屏幕尺寸的设定,都作为DDC数据存储。DDC数据一般存储在显示设备的非易失性存储器的一个区域中。DDC数据可以由外部控制器存取。

图1表示利用DDC系统的视频显示设备的一种可能的结构。DDC数据21存储在非易失性存储器2中。微计算机1通过DDC总线14a和14b可存取DDC数据21。外部控制器5通过通信总线15从微计算机1存取DDC信息。第二DDC外部控制器4可以通过DDC总线14a、14b访问DDC数据非易失性存储器2。

在DDC数据21仅存在于DDC非易失性存储器内的系统中,可能遇到一些困难,这妨碍了外部控制器4快速存取DDC数据21。例如,由于DDC总线不仅与视频显示设备6和外部控制器4相连,而且还可以与鼠标等相连,所以当鼠标和外部控制器4之间的通信占用DDC总线时,计算机1不能再次访问总线14。因此,在微计算机1和DDC非易失性存储器2之间不能进行通信。

此外,如果微计算机1从外部控制器4接收到一个命令,请求微计算机1发送DDC数据之后,微计算机1从非易失性存储器2读出DDC数据21,这将在微计算机1可以向外部控制器4传输DDC数据之前存在延时。如果这一延时超过DDC2AB模式中允许的延时,则将出现错误。

此外,如果保持DDC数据的DDC非易失性存储器2被损坏,那么DDC数据必须重新写入DDC非易失性存储器2’的一个新的部分。该数据必须通过DDC总线14a、14b从DDC外部控制器4写入非易失性存储器2’。如果DDC数据包括视频显示设备特定的数据,例如其序号,那么在DDC外部控制器4能够将DDC数据重新写入未损坏的DDC非易失性存储器2’之前,必须给该控制器4这一信息。

由于DDC非易失性存储器2与可以从视频显示设备6的外部访问的总线相连,所以存储在非易失性存储器2中的DDC数据可能是不可靠的。

鉴于这些问题,本发明的一个目的是提供一种视频显示设备,它能够根据其计算机不能与其DDC非易失性存储器通信时接收的DDC2AB命令,向外设传输正确的DDC数据,以及当DDC非易失性存储器被损坏时,允许视频显示设备特定的DDC数据被写入非易失性存储器的一个新的部分。

根据本发明的一个方面,一种能够与外部控制器通信的视频显示设备包括从外部控制器接收命令的微控制器;用于存储与视频显示设备有关的数据的第一非易失性存储器;用于将外部控制器与微控制器和第一非易失性存储器相连的第一总线;用于存储与第一非易失性存储器中存储的数据相同的数据的第二非易失性存储器;以及用于将第二非易失性存储器与微控制器相连的第二总线。

图1表示现有技术的视频显示设备和外部控制器的结构;

图2表示根据本发明的第一实施例的视频显示设备的结构;

图3表示根据本发明的第二实施例的视频显示设备的结构;

图4是用来说明图3所示的视频显示设备的操作的流程图;

图5是用来说明图3所示的视频显示设备的操作的流程图;

图6是用来说明图3所示的视频显示设备的操作的流程图;以及

图7是用来说明图3所示的视频显示设备的操作的流程图。

根据本发明,视频显示设备利用显示数据通道(DDC)系统,其中DDC非易失性存储器在DDC1和DDC2B模式下不通过CPU与外设通信,以及在DDC2AB模式下通过CPU与外设通信。视频显示设备具有DDC非易失性存储器和通过内部总线与CPU相连的第二非易失性存储器。这两个非易失性存储器都用于存储DDC数据。

图2表示本发明的第一实施例。如图2所示,视频显示设备6包括单片微计算机1,表明DDC系统的非易失性存储器2(DDC非易失性存储器2),以及能够通过内部总线13与微计算机1通信的第二非易失性存储器3。

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