[发明专利]基于同步复原数据的串行并行变换方法及装置无效
| 申请号: | 96105736.X | 申请日: | 1996-02-27 |
| 公开(公告)号: | CN1079979C | 公开(公告)日: | 2002-02-27 |
| 发明(设计)人: | 金柄秀 | 申请(专利权)人: | 三星电子株式会社 |
| 主分类号: | G11B20/10 | 分类号: | G11B20/10 |
| 代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 叶恺东,王岳 |
| 地址: | 韩国*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 基于 同步 复原 数据 串行 并行 变换 方法 装置 | ||
本发明涉及根据同步信号对信息数据进行串行-并行变换的方法及其装置,更详细的说,涉及一种在再现系统所用的磁带、磁盘等记录媒体中即使在空间波发射等信号接收系统中发生同步信号差错的情况下,也能对信息数据正确地进行串行-并行变换的方法及其装置。
随着半导体技术的发展,不仅音频信号甚至宽频带视频信号的数字信号处理也成为可能,随着记录媒体和记录技术的提高,还可能出现全数字信号处理系统。在全数字信号处理系统把一面接收一面将从记录媒体上读取的信息信号根据与该信息信号同时收到并读取的同步信号进行串行-并行变换的情况下,如果发生同步信号差错时,就可能出现所收到并读取的信息信号不能正确地进行串行-并行变换的问题。下面结合标准数字(StandardDigital:SD)VTR系统说明由于差错而不能正确检出同步信号的情况的例子。
为了产品间的互换,许多生产民用数字VCR的公司之间存在关于SD-VCR规格的协议,按照这种SD-VCR规格,音频信号和视频信号调制后,分别用41.85MHZ的串行时钟按比特串的形态记录在磁道上的音频区段和视频区段上。视频信号和音频信号被记录在磁带上之前,要先进行用来减少差错发生的纠错编码和频道调制。迄今为止,虽然已开发的频道调制方法有多种,但是SD-VCR使用的是24/25调制方式。24/25调制方法是在纠错编码得到的3字节(24比特)的并行数据中插入一个其它用途比特,再变换为25字节,所插入的1比特数据根据条件其值为“0”或“1”。这样的调制已披露于美国专利US5,142,421号的“DEVICE FOR RECORDING ADIGITAL INFORMATION SIGNAL ON A RECORD CARRIER”之中。
经过24/25调制的数据按照SD-VCR的规格被变换为串行数据,然后按照比特串形态记录在磁带上,重放时,把这种串行数据进行串行-并行变换(下称S/P变换)使之成为并行数据。这种S/P变换的基准是比特串内的同步信号,根据从比特串中检出的同步信号进行数据的S/P变换。如果这种S/P变换进行得不正确,就不能正确进行下面的25/24解调。
图1是与SD-VCR有关的现有技术的数据S/P变换装置的方框图。
图1的同步信号检测器10从按比特串形态重放的串行数据中检出同步信号,并行时钟发生器12以所检出的各同步信号为基准对串行时钟进行25分频,从而形成并行时钟。S/P变换器14用由串行时钟的25分频所得到的并行时钟把串行数据变换为25比特的并行数据,所变换成的并行数据经过由后级的25/24解调器(未示出)进行的解调过程。
可是,由于数据记录在磁带上时伴随发生的磁变换、磁带运行等主要原因有可能会发生误差,这种误差又会误放同步信号。
图2A~图2B是说明数据S/P变换时可能发生的同步信号差错的类型的示图,图2A所表示的是规则地记载在磁道上的同步信号(表示为□)中的用箭头表示的第2同步信号本身出现了异常,而在该部分没有重放应该放的同步信号的情况。图2B所表示的是规则地记载在磁道上的同步信号(表示为□)间的数据发生了异常(在图面上用箭头表示),而把错误的数据误认为同步信号,在同步信号间检出伪同步信号(伪Sync)的情况。
在SD-VCR正确重放所记录的数据时,这种同步信号会造成致命的影响,但是,图1的装置所示的现有技术的缺点是同步信号中所发生的差错不能予以纠正。
本发明的目的是提供解决上述的缺点而提出的技术方案,其目的是提供一种在应该重放的同步信号未作为同步信号重放的情况和不是同步信号的信号而被作为同步信号重放的情况下均能够正确地复原S/P变换的同步信号的方法。
本发明的其他目的是提供一种采用上述方法的装置。
为实现本发明的上述目的,所提供的根据串行数据信号内的同步信号对所述串行数据信号进行串行-并行变换的方法包括:根据已经设定的同步图形检出串行数据信号内的同步信号的步骤(a);分别地确认具有由前述的步骤(a)检出的各个同步信号是否是与各个原来的同步信号同一串行数据信号位置的真同步信号的步骤(b);根据在所述步骤(b)中所确认的真同步信号的位置,以同步信号产生启动脉冲,去除在所述启动脉冲区间以外的区间之间的串行信号中的伪同步信号的步骤(c);以及用步骤(c)的串行数据信号内的同步信号产生为进行该串行数据信号的串行-并行变换的时钟信号的步骤(d)。
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