[发明专利]计算机主-辅并联式存储体结构和信息存储方式的设计无效
| 申请号： | 96104897.2 | 申请日： | 1996-05-16 |
| 公开（公告）号： | CN1139237A | 公开（公告）日： | 1997-01-01 |
| 发明（设计）人： | 王道通 | 申请（专利权）人： | 王道通 |
| 主分类号： | G06F12/02 | 分类号： | G06F12/02 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 453003*** | 国省代码： | 河南;41 |
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| 摘要： | |||
| 搜索关键词： | 计算 机主 并联 存储 结构 信息 方式 设计 | ||
【权利要求书】：
1、计算机并联式存储体结构设计，其特征在于设置若干个与原主存储体结构、容量相同的辅助存储体；
2、按“位”和按“字”并联存储方式设计的特征在于，通过配置数据信息读出和写入的分合流通道装置，数据信息按“位”或“字”并联存放于各并联存储体内。按“位”并联存入方式，同一指令下，读出速度为并联存储体的倍数；按“字”并联存放方式，同一指令下，同一寻址周期，寻址次数可提高为并联存储体的倍数；
3、按“字”并联存储方式的特征还在于，可实现简单意义上的并联，如两个8位存储体简单并联可获得16位效果，相反16位机的存储体可通过两个8位体并联来实现。
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