[发明专利]用于加速在图形环境中执行安全散列算法2(SHA-2)工作负载的融合指令在审
申请号: | 202210578968.7 | 申请日: | 2022-05-25 |
公开(公告)号: | CN115599289A | 公开(公告)日: | 2023-01-13 |
发明(设计)人: | S·帕尔;W·费格哈利;C·李;W-Y·陈;T·R·鲍尔;A·莱亚谢夫斯基 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F3/06 | 分类号: | G06F3/06;G06F9/50;G06T1/20 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 李炜;黄嵩泉 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 用于 加速 图形 环境 执行 安全 算法 sha 工作 负载 融合 指令 | ||
1.一种处理器,包括:
处理资源,包括执行电路,所述执行电路用于:
接收融合安全散列算法SHA指令,所述融合SHA指令标识长度和函数控制,所述长度与所述融合SHA指令的数据尺寸对应,所述函数控制标识所述融合SHA指令的操作类型;
基于对所述融合SHA指令解码,使由所述长度和所述函数控制标识的子函数被调度到所述执行资源的整数流水线;以及
在所述执行电路的整数流水线中执行所述融合SHA指令的所述子函数,所述子函数用于对所述融合SHA指令的源操作数执行合并的操作,所述合并的操作包括循环移位操作、移位操作和xor操作。
2.如权利要求1所述的处理器,其中,所述融合SHA指令的所述合并的操作执行SHA-2算法的消息调度组成部分。
3.如权利要求1所述的处理器,其中,所述融合SHA指令的所述合并的操作执行SHA-2算法的压缩组成部分。
4.如权利要求1所述的处理器,其中,所述执行电路的所述整数流水线包括:
布线,用于实现所述子函数的所述合并的操作中的所述循环移位操作和所述移位操作;以及
xor电路,用于实现所述xor操作。
5.如权利要求1所述的处理器,其中,所述长度与包括256位或512位中的至少一项的数据尺寸对应。
6.如权利要求1所述的处理器,其中,所述操作类型包括消息调度操作或压缩操作中的至少一项。
7.如权利要求1所述的处理器,其中,所述融合SHA指令标识包括所述源操作数的单个源操作数。
8.如权利要求1所述的处理器,其中,所述处理器包括图形处理单元GPU。
9.如权利要求1所述的处理器,其中,所述处理器是单指令多数据SIMD机器或单指令多线程SIMT机器中的至少一个。
10.一种方法,包括:
由图形处理器的执行资源接收融合安全散列算法SHA指令,所述融合SHA指令标识长度和函数控制,所述长度与所述融合SHA指令的数据尺寸对应,所述函数控制标识所述融合SHA指令的操作类型;
基于对所述融合SHA指令解码,由所述执行资源使由所述长度和所述函数控制标识的子函数被调度到所述执行资源的整数流水线;以及
由所述执行资源的执行电路在所述执行电路的整数流水线中执行所述融合SHA指令的所述子函数,所述子函数用于对所述融合SHA指令的源操作数执行合并的操作,所述合并的操作包括循环移位操作、移位操作和xor操作。
11.如权利要求10所述的方法,其中,所述融合SHA指令的所述合并的操作执行SHA-2算法的消息调度组成部分。
12.如权利要求10所述的方法,其中,所述融合SHA指令的所述合并的操作执行SHA-2算法的压缩组成部分。
13.如权利要求10所述的方法,其中,所述执行电路的所述整数流水线包括:
布线,用于实现所述子函数的所述合并的操作中的所述循环移位操作和所述移位操作;以及
xor电路,用于实现所述xor操作。
14.如权利要求10所述的方法,其中,所述长度与包括256位或512位中的至少一项的数据尺寸对应。
15.如权利要求10所述的方法,其中,所述操作类型包括消息调度操作或压缩操作中的至少一项。
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