[发明专利]一种可编程抽取滤波器电路在审

专利信息
申请号: 202210570484.8 申请日: 2022-05-24
公开(公告)号: CN114866070A 公开(公告)日: 2022-08-05
发明(设计)人: 邵杰;万书芹;蔡国文;卓琳;苏小波;薛颜;蒋颖丹 申请(专利权)人: 中国电子科技集团公司第五十八研究所
主分类号: H03H17/04 分类号: H03H17/04;H03H17/06
代理公司: 无锡派尔特知识产权代理事务所(普通合伙) 32340 代理人: 杨强;杨立秋
地址: 214000 *** 国省代码: 江苏;32
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摘要:
搜索关键词: 一种 可编程 抽取 滤波器 电路
【说明书】:

发明公开一种可编程抽取滤波器电路,属于大规模数字集成电路设计领域,包括系数重映射模块、数据重映射模块、门控时钟模块和卷积模块;卷积模块包括依次相连的延时模块、加法模块、乘法模块、求和模块和溢出保护模块;可编程抽取滤波器电路的输入端口分别为滤波器系数、滤波器长度、抽取倍数、输入数据、时钟1和时钟2,输出端口为输出数据;滤波器系数输入至系数重映射模块,滤波器长度输入至加法模块和求和模块,抽取倍数输入至数据重映射模块和延时模块,输入数据输入至数据重映射模块,时钟1输入至数据重映射模块,时钟2输入至数据重映射模块和门控时钟门控。本发明为高速收发器接收链路提供一种灵活可配置的数字滤波方案。

技术领域

本发明涉及大规模数字集成电路设计技术领域,特别涉及一种可编程抽取滤波器电路。

背景技术

5G的大规模商业应用落地,带来了海量的数据处理需求,在高速、高集成度、超宽带的需求下,高性能收发器应运而生。高性能收发器在接收链路中集成数字信号处理功能,作为主要的信号处理单元,数字滤波器的性能、面积、功耗等决定了整个数字电路的整体表现。如何在满足不同的应用场景的前提下,尽可能减少数字滤波器的面积和功耗已经成为设计重难点。

发明内容

本发明的目的在于提供一种可编程抽取滤波器电路,以解决传统数字滤波器的面积和功耗难以满足高性能要求的问题。

为解决上述技术问题,本发明提供了一种可编程抽取滤波器电路,系数重映射模块、数据重映射模块、门控时钟模块和卷积模块;

其中所述卷积模块包括依次相连的延时模块、加法模块、乘法模块、求和模块和溢出保护模块;所述延时模块对输入数据进行延时,所述加法模块针对延时的输入数据做加法运算,所述乘法模块实现滤波器系数和加法输出的乘法功能,所述求和模块实现乘法模块输出的求和,所述溢出保护模块对求和输出的卷积结果做溢出保护;

所述可编程抽取滤波器电路的输入端口分别为滤波器系数、滤波器长度、抽取倍数、输入数据、时钟1和时钟2,输出端口为输出数据;滤波器系数输入至所述系数重映射模块,滤波器长度输入至所述系数重映射模块、所述门控时钟模块、所述加法模块和所述求和模块,抽取倍数输入至所述数据重映射模块和所述延时模块,输入数据输入至所述数据重映射模块,时钟1输入至所述数据重映射模块,时钟2输入至所述数据重映射模块和所述门控时钟门控;

所述系数重映射模块与所述乘法模块相连,

所述数据重映射模块与所述延时模块相连,

所述门控时钟模块同时与延时模块、加法模块、乘法模块、求和模块相连。

在一种实施方式中,所述抽取倍数能够配置为1,2,4,对应实现1,2,4倍抽取;时钟1和输入数据同频率,时钟2和输出数据同频率;滤波器长度能够配置为24,48,72,对应滤波器系数为12个,24个,36个;滤波器系数为coeff_in_01,coeff_in_02,…,coeff_in_35,coeff_in_36;滤波器系数有三种配置,分别为:

配置A1:当滤波器长度配置为24时,只需要配置coeff_in_01,coeff_in_02,…,coeff_in_11,coeff_in_12;

配置A2:当滤波器长度配置为48时,只需要配置coeff_in_01,coeff_in_02,…,coeff_in_23,coeff_in_24;

配置A3:当滤波器长度配置为72时,需要配置全部系数coeff_in_01,coeff_in_02,…,coeff_in_35,coeff_in_36。

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