[发明专利]像素电路以及显示装置有效
| 申请号: | 202210507902.9 | 申请日: | 2022-05-10 |
| 公开(公告)号: | CN115206242B | 公开(公告)日: | 2023-10-20 |
| 发明(设计)人: | 杨文武;李建雷;袁海江 | 申请(专利权)人: | 重庆惠科金渝光电科技有限公司;惠科股份有限公司 |
| 主分类号: | G09G3/3233 | 分类号: | G09G3/3233 |
| 代理公司: | 深圳市威世博知识产权代理事务所(普通合伙) 44280 | 代理人: | 刘芬芬 |
| 地址: | 401320 *** | 国省代码: | 重庆;50 |
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| 摘要: | |||
| 搜索关键词: | 像素 电路 以及 显示装置 | ||
1.一种像素电路,其特征在于,包括多个阵列分布的像素单元,每个所述像素单元分别包括:
控制单元,所述控制单元连接发光二极管,用于驱动所述发光二极管发光;
初始化单元,连接所述控制单元和所述发光二极管,接收初始化信号,并利用所述初始化信号对所述发光二极管进行初始化;
其中,所述初始化单元包括:
PN结,所述PN结连接所述发光二极管以及初始化信号线,所述初始化信号线用于提供所述初始化信号。
2.根据权利要求1所述的像素电路,其特征在于,所述像素单元包括:
存储电容,其包括第一通路端及第二通路端,其中,所述存储电容的所述第一通路端连接所述控制单元,所述存储电容的所述第二通路端连接所述初始化单元;
所述初始化单元利用所述初始化信号对所述存储电容进行初始化。
3.根据权利要求2所述的像素电路,其特征在于,响应于所述PN结导通时,利用所述初始化信号对所述发光二极管和所述存储电容进行初始化。
4.根据权利要求3所述的像素电路,其特征在于,所述初始化信号为固定低电平信号;或
所述初始化信号为可控电压信号。
5.根据权利要求3所述的像素电路,其特征在于,所述PN结的阳极连接所述发光二极管,所述PN结的阴极连接所述初始化信号线。
6.根据权利要求1~5任一项所述的像素电路,其特征在于,所述控制单元包括:
电源提供单元,接收发光使能信号,并根据所述发光使能信号而为所述像素单元的发光二极管提供电源信号;
写入单元,接收扫描信号,并在所述扫描信号的驱动下写入驱动信号;
驱动单元,连接所述写入单元和所述电源提供单元,以根据写入的所述驱动信号而利用所述电源信号生成匹配所述驱动信号的驱动电流,从而利用所述驱动电流驱动所述发光二极管。
7.根据权利要求6所述的像素电路,其特征在于,所述电源提供单元包括:
第一晶体管,其包括控制端、第一通路端和第二通路端,其中,所述第一晶体管的所述控制端连接发光使能信号线以接收所述发光使能信号,所述第一晶体管的所述第一通路端连接电源信号线以接收电源信号,所述第一晶体管的所述第二通路端连接至所述驱动单元;其中,所述第一晶体管的所述第二通路端与所述驱动单元的连接点定义为第一节点;
第二晶体管,其包括控制端、第一通路端和第二通路端,其中,所述第二晶体管的所述控制端连接发光使能信号线以接收所述发光使能信号,所述第二晶体管的所述第一通路端连接所述驱动单元,所述第二晶体管的所述第二通路端连接所述发光二极管,其中,所述第二晶体管的所述第二通路端与所述发光二极管的连接点定义为第二节点。
8.根据权利要求7所述的像素电路,其特征在于,所述驱动单元包括:
第三晶体管,其包括控制端、第一通路端和第二通路端,其中,所述第三晶体管的所述控制端连接所述电源提供单元,所述第三晶体管的所述第一通路端连接所述第一节点,所述第三晶体管的所述第二通路端连接所述电源提供单元。
9.根据权利要求7所述的像素电路,其特征在于,所述写入单元包括:
第四晶体管,其包括控制端、第一通路端和第二通路端,其中,所述第四晶体管的所述控制端连接扫描信号线以接收所述扫描信号,所述第四晶体管的第一通路端连接驱动信号线,以接收所述驱动信号,所述第四晶体管的第二通路端连接所述第一节点;
第五晶体管,其包括控制端、第一通路端和第二通路端,其中,所述第五晶体管的所述控制端连接扫描信号线以接收所述扫描信号,所述第五晶体管的第一通路端连接所述驱动单元,所述第五晶体管的第二通路端连接所述电源提供单元。
10.一种显示装置,其特征在于,其包括:
芯片,
像素电路,连接所述芯片,所述像素电路包括如权利要求1-9任一项所述的像素电路。
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