[发明专利]一种基于有限状态机的数字分集拷贝编码器及方法有效

专利信息
申请号: 202210479554.9 申请日: 2022-05-05
公开(公告)号: CN114978420B 公开(公告)日: 2023-05-16
发明(设计)人: 李知昊;林毅;周健;李卓栋;刘怡豪 申请(专利权)人: 重庆邮电大学
主分类号: H04L1/00 分类号: H04L1/00
代理公司: 北京同恒源知识产权代理有限公司 11275 代理人: 廖曦
地址: 400065 *** 国省代码: 重庆;50
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摘要:
搜索关键词: 一种 基于 有限状态机 数字 分集 拷贝 编码器 方法
【权利要求书】:

1.一种基于有限状态机的数字分集拷贝编码器,其特征在于:包括输入电路、输入存储电路、状态机、交织器电路、输出存储电路和输出电路;

所述输入电路、交织器电路和输出电路连接所述状态机的输入端;其中,输入电路与状态机输入端相连用于发送input_done发送完成信号给状态机,交织器电路与状态机输入端相连用于发送inter_done交织完成信号给状态机,输出电路与状态机输入端相连用于发送output_done输出完成信号给状态机;

所述输入电路、输入存储电路、交织器电路、输出存储电路和输出电路连接所述状态机的输出端;其中,输入电路与状态机输出端相连用于接收en_input输入使能信号,输入存储电路与状态机输出端相连用于接收状态机计算出的地址参数以及需要传输比特数量,交织器电路与状态机输出端相连用于接收en_inter交织使能信号以及移位步长数据,输出存储电路与状态机输出端相连接收ping-pang_sel信号用于选取合适的RAM输入或输出,输出电路与状态机输出端相连用于接收en_output输出使能信号;

所述输入电路连接所述输入存储电路,控制数据向输入存储电路中RAM的写入;

所述输入存储电路、交织器电路和输出存储电路相互连接,所述输出电路连接所述输出存储电路、输入存储电路。

2.根据权利要求1所述的一种基于有限状态机的数字分集拷贝编码器,其特征在于:所述状态机包括IDLE等待状态、INPUT输入状态、INTER交织状态和OUTPUT输出状态。

3.根据权利要求1所述的一种基于有限状态机的数字分集拷贝编码器,其特征在于:状态机内部存储了26种分集拷贝模式对应的各种数据,状态机根据上级发送的分集拷贝模式和频段信号选取正确的数据开始工作。

4.根据权利要求1所述的一种基于有限状态机的数字分集拷贝编码器,其特征在于:输入编码器的数据为四比特数据,编码器输出的数据也为四比特数据。

5.根据权利要求1所述的一种基于有限状态机的数字分集拷贝编码器,其特征在于:所述输入存储电路包括一个2080*4位的RAM以及两个64*4位的RAM;所述输出存储电路包括64*4位的RAM1和64*4位的RAM2,RAM1和RAM2构成ping_pang buffer。

6.根据权利要求5所述的一种基于有限状态机的数字分集拷贝编码器,其特征在于:基于RAM1和RAM2构成的ping_pang buffer,两个RAM能够同时工作,即RAM1输入数据、RAM2输出数据或者RAM1输出数据、RAM2输入数据,使状态机能够同时工作在INTER交织状态和OUTPUT输出状态。

7.用于权利要求1~6中任一项所述基于有限状态机的数字分集拷贝编码器的数据分集拷贝方法,其特征在于:该方法包括以下步骤:

S1、设置状态机的初始状态为IDLE等待状态,当状态机接收到en使能信号后,检测接收到的分集拷贝模式,若模式为内部预设时,状态机进入INPUT输入状态;

S2、状态机输出en_input输入使能信号到输入电路,输入电路开始工作,接收待分集拷贝的数据,将数据输出到输入存储电路;数据输入完成后,输入电路向状态机发送input_done信号,状态机根据参数设置进入INTER交织状态或者OUTPUT输出状态;

S3、如果状态机进入INTER交织状态,将向交织器电路发送en_inter信号,交织器电路将根据状态机送入的参数进行数据交织以及移位的计算,将输入存储电路中的数据取出放入输出存储电路中;当第一个交织器长度的数据处理完后,交织器电路向状态机发送inter_done信号,状态机同时控制输出电路进入OUTPUT输出状态;

S4、状态机进入OUTPUT输出状态,向输出电路发送en_output信号,输出电路将根据分集拷贝模式从输入存储电路过或输出存储电路中取出数据进行输出,输出完成后向状态机发送output_done信号;

S5、当所有数据发送完成以后,状态机进入IDLE等待状态,同时状态机控制所有电路复位,所有计数器清零,所有计算出的参数清零,完成此次分集拷贝。

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