[实用新型]一种量子密钥分发的光源编码驱动系统有效

专利信息
申请号: 202121430662.4 申请日: 2021-06-26
公开(公告)号: CN215871436U 公开(公告)日: 2022-02-18
发明(设计)人: 郭邦红;胡敏 申请(专利权)人: 广东国腾量子科技有限公司
主分类号: H04L9/08 分类号: H04L9/08;H04B10/70
代理公司: 暂无信息 代理人: 暂无信息
地址: 526238 广东省肇庆市*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 量子 密钥 分发 光源 编码 驱动 系统
【权利要求书】:

1.一种量子密钥分发的光源编码驱动系统,其特征在于,包括偏振编码驱动单元,相位编码驱动单元,衰减控制驱动单元和控制单元,所述偏振编码驱动单元,相位编码驱动单元,衰减控制驱动单元分别与控制单元连接,其中:

所述偏振编码驱动单元与偏振调制器连接,用于驱动与控制偏振调制器,为所述偏振调制器提供RF激励信号和偏置电压;

所述相位编码驱动单元与相位调制器连接,用于驱动与控制相位调制器,为相位调制器提供RF激励信号;

所述衰减控制驱动单元与衰减器连接,用于调节衰减器衰减值,为衰减器提供模拟量调节信号;

所述控制单元用于调节偏振编码驱动单元RF的频率、幅度、延时以及偏置电压的大小;所述控制单元用于调节相位编码驱动单元RF的频率、幅度、及延时;所述控制单元用于调节衰减控制驱动单元输出的模拟量数值。

2.如权利要求1所述的一种量子密钥分发的光源编码驱动系统,其特征在于,所述偏振编码驱动单元包括第一信号延迟电路,第二信号延迟电路,第一高速数模转换DAC电路、第一信号放大电路和第二低速数模转换DAC电路,其中:

所述第一信号延迟电路,第二信号延迟电路通过各自的输入端口分别与控制单元连接;

所述第一信号延迟电路的输出端口与第二信号延迟电路输入端口连接,所述第二信号延迟电路输出端口与所述第一高速数模转换DAC电路连接;

所述第一高速数模转换DAC电路、第一信号放大电路和偏振调制器依次顺序连接;

所述第二低速数模转换DAC电路输入端与控制单元连接,输出端与偏振调制器连接。

3.如权利要求2所述的一种量子密钥分发的光源编码驱动系统,其特征在于,所述控制单元发送出RF_IN脉冲信号依次经过第一信号延迟电路,第二信号延迟电路进行两次延迟处理后输入到第一高速数模转换DAC电路中,第一高速数模转换DAC电路根据接收的RF_IN脉冲信号,随机输出水平、垂直、正45度、负45度偏振态的信号光对应的不同幅度的脉冲,然后输入到第一信号放大电路经放大后,再输入到偏振调制器驱动偏振调制器;

所述第二低速数模转换DAC电路接收控制单元通过SPI总线传输的设置参数,调节偏振调制器的偏置电压。

4.如权利要求2所述的一种量子密钥分发的光源编码驱动系统,其特征在于,所述第一信号延迟电路和第二信号延迟电路均设置有延时芯片,两片所述延时芯片串行级联,两片芯片分别通过延时配置口与控制单元连接,通过控制单元连接配置延时芯片的延时时间;

所述高速数模转换DAC电路采用AD970X系列的DAC芯片,控制单元通过SPI总线配置DAC芯片。

5.如权利要求2所述的一种量子密钥分发的光源编码驱动系统,其特征在于,所述第一信号放大电路包括高速运放芯片,放大后的信号输入到偏振调制器;

所述控制单元通过SPI总线配置所述第二低速数模转换DAC电路输出模拟电压输出值,第二低速数模转换DAC电路发的输出端口连接到偏振调制器偏置电压输入端。

6.如权利要求1所述的一种量子密钥分发的光源编码驱动系统,其特征在于,所述相位编码驱动单元包括第三延时电路,第四延时电路,第三高速数模转换DAC电路和第三信号放大电路;

所述第三信号延迟电路,第四信号延迟电路通过各自的输入端口分别与控制单元连接,所述第三信号延迟电路的输出端口与第四信号延迟电路连接,所述第四信号延迟电路端口与所述第三高速数模转换DAC电路连接;所述第三高速数模转换DAC电路、第二信号放大电路和相位调制器依次顺序连接。

7.如权利要求6所述的一种量子密钥分发的光源编码驱动系统,其特征在于,所述控制单元发送出RF_IN脉冲信号依次经过第三信号延迟电路,第四信号延迟电路进行两次延迟处理后输入到第三高速数模转换DAC电路中,第三高速数模转换DAC电路根据接收的RF_IN脉冲信号,随机输出0,π,π/2,3π/2四种相位的信号光对应的不同幅度的脉冲,然后输入到第三信号放大电路经放大后输入到相位调制器驱动相位调制器。

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