[实用新型]一种调整strapping pin信号初始值的装置有效
申请号: | 202120826407.5 | 申请日: | 2021-04-21 |
公开(公告)号: | CN214670578U | 公开(公告)日: | 2021-11-09 |
发明(设计)人: | 李振毅 | 申请(专利权)人: | 山东英信计算机技术有限公司 |
主分类号: | G06F13/38 | 分类号: | G06F13/38;G06F13/40;G06F13/42 |
代理公司: | 济南诚智商标专利事务所有限公司 37105 | 代理人: | 李修杰 |
地址: | 250001 山东省济南市高新区*** | 国省代码: | 山东;37 |
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摘要: | |||
搜索关键词: | 一种 调整 strapping pin 信号 初始值 装置 | ||
本申请公开了一种调整strapping pin信号初始值的装置,该装置包括:非挥发性GPIO芯片、第一连接器、第二连接器和多个Buffer缓冲器。非挥发性GPIO芯片通过I2C总线与BMC通信连接,非挥发性GPIO芯片还分别通过PCB板上的PRSNT引脚和BIF引脚连接至主板的PCH,非挥发性GPIO芯片还分别通过PRSNT引脚和BIF引脚与外接设备卡通信连接,PCH通过PCIE信号与外接设备卡连接,第一连接器的一端连接非挥发性GPIO芯片,第一连接器的另一端分别连接BMC、PCH和外接设备卡,第二连接器的一端连接PCH,第二连接器的另一端连接外接设备卡,多个Buffer缓冲器设置于非挥发性GPIO芯片与BMC、PCH以及外接设备的信号线上。通过该装置,能够有效提高strapping pin信号初始值的调整效率,进而提高整个服务器架构的运行效率。
技术领域
本申请涉及PCB(Printed Circuit Board,印刷电路板)板线路设计技术领域,特别是涉及一种调整strapping pin(复用引脚)信号初始值的装置。
背景技术
随着服务器架构的复杂化,服务器上所使用的IC(Integrated Circuit,集成电路) 或外设的数量越来越多,相应地,为实现更多功能,IC或外设的strapping pin也相对变多。如何对strapping pin的初始值进行设置和调整,是个重要的技术问题。
目前,调整strapping pin信号初始值的装置,通常是在IC或外设的外部线路设计固定的上拉电阻和下拉电阻来调整strapping pin信号初始值。具体地,当IC或外设的strapping pin初始值需要设定成低电平时,需要下拉电组接地,然后预留上拉电阻到STBY的电,通常此预设初始值都是接上standby的电;当IC或外设的strapping pin 初始值需要设定成高电平时,需要上拉电阻接到standby的电,然后预留下拉电阻接地,然后利用修改BOM change的方式来设置strapping pin的初始值。从而达到开机时IC 或外设能够读到正确的strapping pin初始值,确保IC或外设能够正常运行。
然而,目前调整strapping pin信号初始值的装置,由于采用上拉和下拉电阻,当需要调整strapping pin信号初始值时,需要重置上拉电阻或者下拉电阻才能实现,这就导致strapping pin信号初始值的调整比较繁琐,调整效率太低,从而影响整个服务器架构的运行效率。
实用新型内容
本申请提供了一种调整strapping pin信号初始值的装置,以解决现有技术中调整 strapping pin信号初始值的装置调整效率太低的问题。
为了解决上述技术问题,本申请实施例公开了如下技术方案:
一种调整strapping pin信号初始值的装置,所述装置设置于一PCB板上,所述装置包括:非挥发性GPIO(General-purpose input/output,通用型之输入输出)芯片、第一连接器、第二连接器和多个Buffer缓冲器;
所述非挥发性GPIO芯片通过I2C总线与BMC(Baseboard Management Controller,基板管理控制器)通信连接,所述非挥发性GPIO芯片还分别通过PCB板上的PRSNT引脚和BIF引脚连接至主板的PCH(Platform Controller Hub,平台控制器中心,intel 公司的集成南桥),所述非挥发性GPIO芯片还分别通过所述PRSNT引脚和BIF引脚与外接设备卡通信连接,所述PCH通过PCIE(peripheral component interconnect express,一种高速串行计算机扩展总线标准)信号与外接设备卡连接,所述第一连接器的一端连接非挥发性GPIO芯片,所述第一连接器的另一端分别连接BMC、PCH和外接设备卡,所述第二连接器的一端连接PCH,所述第二连接器的另一端连接外接设备卡,多个Buffer 缓冲器设置于非挥发性GPIO芯片与BMC、PCH以及外接设备的信号线上。
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