[发明专利]显示驱动集成电路、显示装置及其操作方法在审
| 申请号: | 202111502509.2 | 申请日: | 2021-12-09 |
| 公开(公告)号: | CN114630059A | 公开(公告)日: | 2022-06-14 |
| 发明(设计)人: | 李钟炫;权暻奂;李钟奥;郑允硕 | 申请(专利权)人: | 三星电子株式会社 |
| 主分类号: | H04N5/268 | 分类号: | H04N5/268;H04N5/76;H04N5/765;H04N17/00;G09G3/20;G09G5/00 |
| 代理公司: | 北京天昊联合知识产权代理有限公司 11112 | 代理人: | 赵南;肖学蕊 |
| 地址: | 韩国*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 显示 驱动 集成电路 显示装置 及其 操作方法 | ||
1.一种显示驱动集成电路,包括:
主机接口,其被配置为从主机装置接收图像数据;
接口监视器,其被配置为通过检测来自所述主机装置的所述图像数据是否通过所述主机接口被传送来生成指示静止图像模式或视频模式的模式信号;
处理电路,其被配置为通过处理所述图像数据来生成经处理的数据;
转换电路,其被配置为对所述经处理的数据执行数据转换以生成驱动显示面板的显示数据;以及
路径控制器,其被配置为在所述静止图像模式中将所述经处理的数据存储在帧缓冲器中并将存储在所述帧缓冲器中的所述经处理的数据传送到所述转换电路,并且还被配置为在所述视频模式中将所述经处理的数据传送到所述转换电路而不将所述经处理的数据存储在所述帧缓冲器中。
2.如权利要求1所述的显示驱动集成电路,还包括:
编码器,其被设置在所述处理电路与所述帧缓冲器之间,并且被配置为压缩所述经处理的数据以生成压缩后的数据,并且将所述压缩后的数据存储在所述帧缓冲器中;以及
解码器,其被设置在所述帧缓冲器与所述转换电路之间,并且被配置为将来自所述帧缓冲器的所述压缩后的数据解压缩以再次生成所述经处理的数据并将所述经处理的数据传送至所述转换电路。
3.如权利要求1所述的显示驱动集成电路,其中,所述路径控制器包括:
第一路径选择器,其被配置为响应于所述模式信号,在所述静止图像模式中将所述经处理的数据提供给连接到所述帧缓冲器的第一路径,并且在所述视频模式中将所述经处理的数据提供给未连接到所述帧缓冲器的第二路径;以及
第二路径选择器,其被配置为响应于所述模式信号,在所述静止图像模式中通过连接到所述帧缓冲器的第三路径将所述经处理的数据提供给所述转换电路,并且在所述视频模式中通过所述第二路径将所述经处理的数据提供给所述转换电路。
4.如权利要求1所述的显示驱动集成电路,其中,所述处理电路响应于所述模式信号在所述静止图像模式中被禁用。
5.如权利要求1所述的显示驱动集成电路,其中,所述路径控制器在所述视频模式中将所述图像数据中包括的数据帧存储在所述帧缓冲器中。
6.如权利要求5所述的显示驱动集成电路,其中,所述接口监视器还被配置为当在待机时间期间所述数据帧未通过所述主机接口被传送时,生成指示从所述视频模式到所述静止图像模式的模式转换的模式转换信号。
7.如权利要求6所述的显示驱动集成电路,其中,所述路径控制器还被配置为将最近存储在所述帧缓冲器中的最后数据帧传送至所述处理电路,并且将通过使用所述处理电路处理所述最后数据帧而生成的最后经处理的数据帧存储在所述帧缓冲器中,使得基于存储在所述帧缓冲器中的所述最后经处理的数据帧来执行所述静止图像模式。
8.如权利要求1所述的显示驱动集成电路,其中,所述接口监视器还被配置为从所述主机装置接收模式转换信息,其中,所述模式转换信息指示所述图像数据中包括的数据帧是所述视频模式的最后数据帧,并且响应于所述模式转换信息生成指示从所述视频模式到所述静止图像模式的模式转换的模式转换信号。
9.如权利要求8所述的显示驱动集成电路,其中,所述路径控制器还被配置为将通过由所述处理电路处理所述最后数据帧而生成的最后经处理的数据帧存储在所述帧缓冲器中,使得响应于存储在所述帧缓冲器中的所述最后经处理的数据帧执行所述静止图像模式。
10.如权利要求1所述的显示驱动集成电路,其中,所述转换电路还被配置为针对所述经处理的数据执行抖动以生成所述显示数据。
11.如权利要求1所述的显示驱动集成电路,还包括:
行缓冲器,其设置在所述主机接口与所述处理电路之间,并且被配置为通过缓冲所述图像数据来生成经缓冲的图像数据,并且以行为单位提供所述经缓冲的图像数据。
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