[发明专利]多深度缓冲激活重发方法及装置在审

专利信息
申请号: 202111201772.8 申请日: 2021-10-15
公开(公告)号: CN113900816A 公开(公告)日: 2022-01-07
发明(设计)人: 陈芳园;过锋;吴铁彬;郝子宇;谭弘兵 申请(专利权)人: 无锡江南计算技术研究所
主分类号: G06F9/50 分类号: G06F9/50
代理公司: 浙江千克知识产权代理有限公司 33246 代理人: 杨震
地址: 214100 江苏*** 国省代码: 江苏;32
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摘要:
搜索关键词: 深度 缓冲 激活 重发 方法 装置
【说明书】:

发明实施例提供一种多深度缓冲激活重发方法及装置,所述方法包括:高速缓冲存储器接收到访存请求,获取访存请求的请求地址,根据请求地址判断访存请求是否命中;未命中则发送访存请求进入脱靶缓冲,并设置第一重发标识位;高速缓冲存储器接收到后续未命中请求时,获取后续未命中请求后续地址,与请求地址进行地址相关性判断;当不相关时,发送后续未命中请求进入脱靶缓冲,设置第二重发标识位;检测到脱靶缓冲中的访存请求和后续未命中请求完成从主存装载后,通过激活重发步骤,对脱靶缓冲中的访存请求进行重发。采用本方法能够支持访存请求的乱序发射和乱序完成,同时保证脱靶请求重发后的正确性,从而提高数据Cache的性能和效率。

技术领域

本发明涉及计算机处理器技术领域,尤其涉及一种多深度缓冲激活重发方法及装置。

背景技术

数据Cache(高速缓冲存储器)是计算机存储系统的重要组成部分,高性能数据Cache设计对于计算机存储系统的性能和效率都有着决定性的影响,也对计算机系统的整体性能有着至关重要的作用。

数据Cache在执行过程中,为了保证程序执行的正确性,需要确保访存顺序。在程序执行的过程中,地址相关的访存请求需要保证执行顺序和完成顺序以保证程序的正确性,但是地址不相关的访存请求可以乱序执行和乱序完成。目前的数据Cache只保证前一个访存请求顺利完成后才能执行下一个请求,访存请求按顺序执行和按顺序完成,地址不相关的访存请求也要求按顺序执行和完成,这导致Cache在遇到地址相关的访存请求时,只能等待前一个访存请求完成才可以开始执行下一个访存请求,地址无关的访存请求也无法插空流水执行,对Cache性能有着较大的影响。

发明内容

针对现有技术中存在的问题,本发明实施例提供一种多深度缓冲激活重发方法及装置。

本发明实施例提供一种多深度缓冲激活重发方法,包括:

当高速缓冲存储器接收到访存请求时,获取所述访存请求的请求地址,根据所述请求地址判断所述访存请求是否命中,所述高速缓冲存储器包含请求缓冲和脱靶缓冲;

当所述访存请求未命中所述高速缓冲存储器,则发送所述访存请求进入所述脱靶缓冲,并在所述请求缓冲中设置所述访存请求对应的第一重发标识位;

所述高速缓冲存储器接收到所述访存请求的后续未命中请求时,获取所述后续未命中请求的后续地址,并根据所述后续地址与所述请求地址进行地址相关性判断;

当所述相关性判断结果为不相关时,发送所述后续未命中请求进入所述脱靶缓冲,在所述请求缓冲中设置所述后续未命中请求对应的第二重发标识位,并根据所述第一重发标识位和第二重发标识位设置重发序;

检测到所述脱靶缓冲中的访存请求和后续未命中请求完成从主存装载后,通过预设的激活重发步骤,按照所述重发序对所述脱靶缓冲中的访存请求进行重发。

在其中一个实施例中,所述方法还包括:

当所述访存请求命中所述高速缓冲存储器,则根据所述访存请求对所述高速缓冲存储器中的对应数据进行访问,并获取所述访存请求的请求来源,根据所述请求来源返回所述高速缓冲存储器中的对应数据。

在其中一个实施例中,所述方法还包括:

当所述相关性判断结果为相关时,在所述请求缓冲中设置所述后续未命中请求对应的第一重发标识位。

在其中一个实施例中,所述方法还包括:

将发送完成信号发送至所述请求缓冲中的激活重发装置,所述激活重发装置根据所述发送完成信号,对所述重发标识位相同的访存请求按照所述重发序进行重发。

在其中一个实施例中,所述方法还包括:

获取所述第一重发标识位对应的第一标识时间,第二重发标识位对应的第二标识时间,并对比所述第一标识时间及第二标识时间;

根据对比结果中的时间先后顺序设置所述重发序。

本发明实施例提供一种多深度缓冲激活重发装置,包括:

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