[发明专利]存储器装置、存储器系统及控制其存储器装置的方法在审
| 申请号: | 202111118508.8 | 申请日: | 2021-09-23 |
| 公开(公告)号: | CN114694715A | 公开(公告)日: | 2022-07-01 |
| 发明(设计)人: | 阙欣男;陈文良;刘景宏 | 申请(专利权)人: | 爱普科技股份有限公司 |
| 主分类号: | G11C16/06 | 分类号: | G11C16/06 |
| 代理公司: | 北京威禾知识产权代理有限公司 11838 | 代理人: | 王月玲 |
| 地址: | 中国台湾新竹县*** | 国省代码: | 台湾;71 |
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| 摘要: | |||
| 搜索关键词: | 存储器 装置 系统 控制 方法 | ||
1.一存储器装置,包括:
一第一存储器芯片,包括一第一存储器空间及一第二存储器空间;
一非易失性存储器电路,用以储存对应于该第一存储器空间的一第一修复表档案;以及
一逻辑芯片,耦接至该第一存储器芯片及该非易失性存储器电路,该逻辑芯片用以根据一输入地址及该第一修复表档案的一比较结果而选择性地存取该第一存储器芯片的该第二存储器空间或该第一存储器空间;
其中该第一存储器芯片不同于该逻辑芯片。
2.如权利要求1所述的存储器装置,其中:
该非易失性存储器电路是形成于该第一存储器芯片中;
该非易失性存储器电路是形成于该逻辑芯片中;或
该非易失性存储器电路是形成于与该第一存储器芯片及该逻辑芯片不同的一第三芯片中。
3.如权利要求1所述的存储器装置,更包括:
复数个互连结构,夹设于该第一存储器芯片及该逻辑芯片间,以供电性连接该第一存储器芯片及该逻辑芯片。
4.如权利要求1所述的存储器装置,更包括:
一第一信号路径,用以连接该第一存储器空间及该逻辑芯片;以及
一第二信号路径,用以连接该第二存储器空间及该逻辑芯片;
其中当该比较结果指出该输入地址不符合记录于该第一修复表档案中的任一地址时,该逻辑芯片用以经由该第一信号路径存取该第一存储器空间中的该输入地址,且当该比较结果指出该输入地址符合记录于该第一修复表档案中的一地址时,该逻辑芯片用以经由该第二信号路径存取该第二存储器空间中的一特定地址。
5.如权利要求4所述的存储器装置,其中该特定地址是记录于该第一修复表档案中。
6.如权利要求4所述的存储器装置,其中该第一信号路径是由夹设于该第一存储器芯片及该逻辑芯片间的复数个第一互连结构所组成,且该第二信号路径是由夹设于该第一存储器芯片及该逻辑芯片间的复数个第二互连结构所组成。
7.如权利要求1所述的存储器装置,其中:
该第一存储器芯片更包括一第一电子身份标识(EID),用于记录该第一存储器芯片的一第一识别数据;以及
该第一修复表档案是与该第一存储器芯片的该第一识别数据的相关地储存于该非易失性存储器电路中。
8.如权利要求7所述的存储器装置,更包括:
一第二存储器芯片,其不同于该第一存储器芯片及该逻辑芯片,该第二存储器芯片包括一第三存储器空间及一第四存储器空间,该第二存储器芯片更包括一第二电子身份标识,用于记录该第二存储器芯片的一第二识别数据,其中该第三存储器空间的一第二修复表档案是与该第二识别数据相关地储存于该非易失性存储器电路中,且该逻辑芯片更用以:
根据该输入地址选择该第一修复表档案及该第二修复表档案其中之一作为一所选修复表档案,
比较该输入地址与该所选修复表档案;以及
当该所选修复表档案是该第二修复表档案时,根据该输入地址及该所选修复表档案的一比较结果,选择性地存取该第二存储器芯片的该第四存储器空间或该第三存储器空间。
9.如权利要求1所述的存储器装置,其中该非易失性存储器电路为一可多次编程(multiple-time programmable,MTP)存储器。
10.如权利要求1所述的存储器装置,其中:
该逻辑芯片包括一影子存储器,用以在该存储器装置通电时,自该非易失性存储器电路映射该第一修复表档案的一复本;以及
该逻辑芯片用以自该影子存储器取得该第一修复表档案的该复本,以及比较该输入地址及该第一修复表档案的该复本以产生该比较结果。
11.如权利要求10所述的存储器装置,其中该影子存储器包括复数个静态随机存取存储器(SRAM)单元。
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