[发明专利]自动检查服务器与GPU箱互连线缆错插的方法及装置在审
申请号: | 202111065477.4 | 申请日: | 2021-09-10 |
公开(公告)号: | CN113791368A | 公开(公告)日: | 2021-12-14 |
发明(设计)人: | 田东顺;殷奎龙 | 申请(专利权)人: | 苏州浪潮智能科技有限公司 |
主分类号: | G01R31/67 | 分类号: | G01R31/67;G01R31/68;G01R31/54 |
代理公司: | 济南舜源专利事务所有限公司 37205 | 代理人: | 张营磊 |
地址: | 215100 江苏省苏州*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 自动 检查 服务器 gpu 互连 线缆 方法 装置 | ||
1.一种自动检查服务器与GPU箱互连线缆错插的方法,其特征在于,包括如下步骤:
S1.在用于对接服务器与GPU箱的每对PCIe端口的每根高速线缆中设置在位信号线,并设置在位信号线第一端与GPU箱的第一CPLD芯片连接,以及设置在位信号线第二端与服务器的第二CPLD芯片连接;
S2.第一CPLD芯片通过GPIO管脚产生不同频率信号,并通过连接的在位信号线向第二CPLD芯片发送;
S3.设置在服务器中的BMC解析第二CPLD芯片的GPIO管脚连接的在位信号线的实际信号频率,并判断各实际信号频率是否与对应预设信号频率相同,进而判定是否出现互连线缆错插漏插,以及定位错插漏插线缆的序号。
2.如权利要求1所述的自动检查服务器与GPU箱互连线缆错插的方法,其特征在于,步骤S1具体步骤如下:
S11.在用于连接服务器与GPU箱的每对PCIe端口的每根高速线缆中设置一根在位信号线;
S12.设置各在位信号线第一端与GPU箱的第一CPLD芯片的一个第一GPIO管脚连接;
S13.设置各在位信号线第二端与服务器的第二CPLD芯片的一个第二GPIO管脚连接;
S14.设置服务器中BMC通过I2C信号线与第二CPLD芯片连接,以及设置BMC的第三GPIO管脚连接LED告警指示灯。
3.如权利要求2所述的自动检查服务器与GPU箱互连线缆错插的方法,其特征在于,步骤S2具体步骤如下:
S21.第一CPLD芯片控制每个第一GPIO管脚的电平状态,从而产生不同频率的方波信号;
S22.第一CPLD芯片将每个第一GPIO管脚产生的方波信号频率值及对应第一GPIO管脚所在GPU箱物理通道存储在GPU箱端物理通道信号频率表中。
4.如权利要求3所述的自动检查服务器与GPU箱互连线缆错插的方法,其特征在于,步骤S3具体步骤如下:
S31.第二CPLD芯片的每个第二GPIO管脚独立采集连接的在位信号线的频率值;
S32.第二CPLD芯片将各第二GPIO管脚采集的频率值存储到内部寄存器中,内部寄存器与服务器端物理通道对应;
S33.BMC通过I2C接口定时访问内部寄存器,获取全部频率值;
S34.BMC根据GPU箱端物理通道信号频率表中GPU箱物理通道与频率值对应关系,解析出各频率值对应的GPU箱的物理通道编码,确定服务器物理通道与GPU箱物理通道的线缆连接关系。
5.如权利要求4所述的自动检查服务器与GPU箱互连线缆错插的方法,其特征在于,步骤S31具体步骤如下:
S311.第二CPLD芯片根据内部定时器设定采样周期;
S312.第二CPLD芯片按照采样周期采集各第二GPIO管脚的电平变化沿启动和停止计数器,统计出各第二GPIO管脚高电平持续时间T_H和低电平持续时间T_L;
S313.第二CPLD芯片计算出每个第二GPIO管脚采集的信号频率值F=1/(T_H+T_L)。
6.如权利要求5所述的自动检查服务器与GPU箱互连线缆错插的方法,其特征在于,步骤S34具体步骤如下:
S341.BMC获取GPU箱端物理通道信号频率表;
S342.BMC定位内部寄存器中一个频率值及其服务器端物理通道;
S343.BMC解析出定位的频率值在GPU箱端物理通道信号频率表中对应的GPU箱的物理通道编码,生成服务器端物理通道与GPU箱物理通道的线缆连接关系;
S344.当BMC获取不到某个服务器端物理通道的频率值时,判断该服务器端物理通道没有插接线缆,点亮LED告警指示灯,并通过管理网络上报错误,记录对应错误日志;
S345.当BMC获取到全部服务器端物理通道的频率值,但在对应的GPU箱端物理通道信号频率表中没有查找到任一频率值或者出现重复的频率值错误时,BMC判定出现频率错误,点亮LED告警指示灯,通过管理网络主动上报,并记录对应的错误日志。
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