[发明专利]一种光学检测控制电路及控制方法在审
申请号: | 202110979981.9 | 申请日: | 2021-08-25 |
公开(公告)号: | CN113551694A | 公开(公告)日: | 2021-10-26 |
发明(设计)人: | 钟永红;唐忠元 | 申请(专利权)人: | 深圳市国芯晟科技有限公司 |
主分类号: | G01D5/26 | 分类号: | G01D5/26;H05B45/345;H05B47/11;G06T7/60;G06T5/00 |
代理公司: | 深圳市科冠知识产权代理有限公司 44355 | 代理人: | 孔丽霞 |
地址: | 518000 广东省深圳市坪山区坪*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 光学 检测 控制电路 控制 方法 | ||
1.一种光学检测控制电路,其特征在于,包括:电源管理模块、控制寄存器模块、时钟发生器、感光图像阵列、模数转换模块、图像处理模块及方向识别模块;所述控制寄存器模块、所述时钟发生器、所述感光图像阵列、所述模数转换模块、所述图像处理模块及所述方向识别模块分别与所述电源管理模块电连接;所述感光图像阵列分别与所述模数转换模块及所述时钟发生器电连接;所述时钟发生器、所述模数转换模块、所述图像处理模块及所述方向识别模块分别与所述控制寄存器模块电连接;所述电源管理模块与电源输入端及地端电连接,所述控制寄存器模块分别与串行数据端、串行时钟端及信号输出端电连接。
2.根据权利要求1所述的一种光学检测控制电路,其特征在于,所述一种光学检测控制电路还包括LED恒流驱动模块;所述恒流驱动模块分别与所述电源管理模块、所述时钟发生器、所述控制寄存器模块及LED灯连接端电连接。
3.根据权利要求1或2所述的一种光学检测控制电路,其特征在于,所述一种光学检测控制电路还包括接口处理模块;所述接口处理模块分别与所述电源管理模块及所述控制寄存器模块电连接;所述串行数据端及所述串行时钟端均与所述接口处理模块电连接。
4.根据权利要求1所述的一种光学检测控制电路,其特征在于,所述电源管理模块包括电源管理单元、模拟LDO单元及数字LDO单元;所述模拟LDO单元及所述数字LDO单元分别与所述电源管理单元电连接;所述模拟LDO单元与所述感光图像阵列电连接,所述控制寄存器模块、所述时钟发生器、所述模数转换模块、所述图像处理模块及所述方向识别模块分别与所述数字LDO单元电连接。
5.根据权利要求2所述的一种光学检测控制电路,其特征在于,所述LED恒流驱动模块包括第一场效应管、第二场效应管、第三场效应管、恒流源及电流配置开关;所述恒流源的第一端与所述电源管理模块电连接,所述恒流源的第二端分别与所述第一场效应管的漏极、所述第一场效应管的栅极、所述第二场效应管的栅极及所述电流配置开关的第一端电连接,所述第一场效应管的源极接地,所述第二场效应管的漏极分别与所述第三场效应管的漏极及所述LED灯连接端电连接,所述第二场效应管的源极接地,所述第三场效应管的栅极与所述电流配置开关的第二端电连接,所述第三场效应管的源极接地。
6.根据权利要求4所述的一种光学检测控制电路,其特征在于,所述模拟LDO单元包括第一放大器、第一电阻、第一滑动电阻及第一电容;所述第一放大器的同相输入端用于输入基准电压源,所述第一放大器的反相输入端分别与所述第一电阻的第一端及所述第一滑动电阻的第一端电连接,所述第一放大器的输出端分别与第一电阻的第二端、所述第一电容的第一端及模拟电源输出端电连接,所述第一滑动电阻的第二端接地,所述第一电容的第二端接地。
7.一种光学检测控制方法,其特征在于,包括权利要求1-6任一项所述的一种光学检测控制电路,所述一种光学检测控制方法包括:
光学检测控制电路与红外LED电连接,控制红外LED曝光;
通过所述感光图像阵列采集图像信息;
将所述图像信息的模拟信号转换成数字信号;
对所述数字信号进行图像处理;
接收图像处理结果实现光学移动检测;
依据所述图像处理结果进行方向识别感应。
8.根据权利要求7所述的一种光学检测控制方法,其特征在于,所述一种光学检测控制方法还包括:
获取所述感光图像阵列的图像转化数值;
依据所述图像转化数值实现近距离感应。
9.根据权利要求8所述的一种光学检测控制方法,其特征在于,所述一种光学检测控制方法还包括:
依据所述感光图像阵列实现环境光检测。
10.根据权利要求7所述的一种光学检测控制方法,其特征在于,所述对所述数字信号进行图像处理包括:
通过高斯图像滤波方式,将第一幅N*M的图像进行滤波处理成(N-1)*(M-1)图像;
通过高斯图像滤波方式,将第二幅N*M的图像进行滤波处理成(N-1)*(M-1)图像;
将处理后的所述第一幅N*M的图像及所述第二幅N*M的图像通过Lucas-Kanade光流算法,获取(Vx,Vy);
将(Vx,Vy)进行N次结果平滑处理;
通过FIFO(先进先出)的方式,每次将FIFO里的类容进行累加在除以N后将结果存储到控制寄存器模块。
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