[发明专利]一种综合计算系统在审

专利信息
申请号: 202110952618.8 申请日: 2017-03-28
公开(公告)号: CN113760814A 公开(公告)日: 2021-12-07
发明(设计)人: 何其伟 申请(专利权)人: 上海山里智能科技有限公司
主分类号: G06F15/16 分类号: G06F15/16;G06F15/163
代理公司: 暂无信息 代理人: 暂无信息
地址: 201315 上海市浦*** 国省代码: 上海;31
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摘要:
搜索关键词: 一种 综合 计算 系统
【权利要求书】:

1.一种综合计算系统,其特征在于,

所述综合计算系统包括一个传统计算单元、一个或多个协计算单元、一个或多个自定义IPU总线插槽,一个或多个定制计算单元,

所述传统计算单元直接连接一个或多个协计算单元,

所述传统计算单元、协计算单元、定制计算单元都与IPU总线插槽相连接,传统计算单元连接一个或多个自定义IPU总线插槽,每个协计算单元连接一个或多个自定义IPU总线插槽,每个定制计算单元连接一个自定义IPU总线插槽,

所述自定义IPU总线插槽包括一种或一种以上协议信号线与GPIO信号线,

传统计算单元与协计算单元之间直接通过传统计算单元自带的PCI/PCIe协议信号线进行通信,

传统计算单元与定制计算单元通过自定义IPU总线插槽中传统计算单元自带的的协议信号线进行通信,

协计算单元与定制计算单元通过自定义IPU总线插槽中GPIO信号线进行通信。

2.一种如权利要求1所述的综合计算系统,其特征在于,

传统计算单元与定制计算单元通过自定义IPU总线插槽中传统计算单元自带的PCI/PCIe或USB协议信号线进行通信。

3.一种如权利要求1所述的综合计算系统,其特征在于,

所述传统计算单元采用X86平台或ARM平台,

所述协计算单元采用FPGA平台或CPLD平台。

4.一种如权利要求1所述的综合计算系统,其特征在于,

所述自定义IPU总线插槽为扁触角式金手指、或针孔式EuroCard接插件。

5.一种如权利要求1所述的综合计算系统,其特征在于,

所述协计算单元由通信模块、并行计算模块、接口时序模块组成,

并行计算模块分别与通信模块和接口时序模块相连,

其中:

通信模块与传统计算单元相连,通过传统计算单元自带的协议信号线,与传统计算单元的自带的协议主控制器进行通信,

并行计算模块用于处理并行计算任务,

接口时序模块与定制计算单元相连接,用于控制定制计算单元的外部接口。

6.一种如权利要求5所述的综合计算系统,其特征在于,

所述通信模块用于传统计算单元与协计算单元的通信,由PCI/PCIe总线子模块、PCI/PCIe总线状态机子模块、FIFO子模块、本地总线状态机子模块、本地总线子模块、逻辑控制子模块、配置参数子模块各一个组成,

PCI/PCIe总线子模块、PCI/PCIe总线状态机子模块、FIFO子模块、本地总线状态子模块、本地总线状态机子模块依次相连,配置参数子模块与逻辑控制子模块相连,逻辑控制子模块与FIFO子模块相连,

PCI/PCIe总线子模块与传统计算单元的PCIe协议主控制器相连,本地总线子模块与接口时序模块、或者并行计算模块、或者握手模块相连,

其中:

PCI/PCIe总线子模块完成PCI/PCIe的数据、地址、控制等接口的信息传输,

PCI/PCIe总线状态机子模块完成PCI/PCIe工作状态的自动切换,

FIFO子模块按照先进先出模式存储管理数据,

本地总线状态机子模块用于控制本地总线多种工作状态的自动切换,

本地总线子模块用于实现本地总线的数据、地址、控制等信号传输,

逻辑控制子模块用于控制接口时序模块经过本地总线状态机子模块、FIFO子模块、PCI/PCIe 总线状态机子模块向传统计算单元传输,并用来控制传统计算单元的数据,依次经过PCI/PCIe总线状态机子模块、FIFO子模块、本地总线状态机子模块向接口时序模块传输,

配置参数子模块根据配置的相关参数,初始化逻辑控制子模块。

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