[发明专利]电路板测试方法、装置和设备在审
| 申请号: | 202110633683.4 | 申请日: | 2021-06-07 |
| 公开(公告)号: | CN113376508A | 公开(公告)日: | 2021-09-10 |
| 发明(设计)人: | 席雪华 | 申请(专利权)人: | 展讯通信(上海)有限公司 |
| 主分类号: | G01R31/28 | 分类号: | G01R31/28;G01R1/04 |
| 代理公司: | 上海恒锐佳知识产权代理事务所(普通合伙) 31286 | 代理人: | 黄海霞 |
| 地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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| 摘要: | |||
| 搜索关键词: | 电路板 测试 方法 装置 设备 | ||
本发明公开了一种电路板测试方法、装置和介质,该方法可以由包括个人电脑执行,该方法包括:向被测设备发送第一指令,第一指令用于控制被测设备上的GPO输出第一电平;还向被测设备发送第二指令,第二指令用于指示被测设备上的GPIO上报第一信息,其中,GPO与GPIO相连接,GPO的输出信号作为GPIO的输入信号,接收来自被测设备上报的第一信息,第一信息包括第二电平,当第一电平与第二电平相一致时,确定GPO功能正常。该方法可以准确检测GPO的功能是否正常。
技术领域
本发明涉及集成电路领域,尤其涉及一种电路板测试方法、装置和设备。
背景技术
大部分电子设备都设有人机交互接口,比如按键接口、显示屏接口、摄像机接口等,电子设备的很多外设一般由通用输出(General-purpose output,GPO)控制,所以在电路板生成过程中需要对GPO进行测试。目前的测试方法主要是依赖人工测试,所以存在误判的可能。目前也有通过增加外设(比如现场可编程逻辑门阵列(field-programmable gatearray,FPGA))来实现对GPO的测试,但是这样会带来测试成本高的问题。
发明内容
本发明实施例提供一种电路板测试方法、装置和设备,用以在不借助其它设备的情况下,准确检测GPO的功能是否正常。
第一方面,本发明提供一种电路板测试方法,该方法可以由包括与被测终端相连的PC执行,其中,该方法包括如下步骤:
PC向被测设备发送第一指令,第一指令用于控制被测设备上的通用输出GPO输出第一电平。PC还向被测设备发送第二指令,第二指令用于指示被测设备上的通用输入输出GPIO上报第一信息,其中,GPO与GPIO相连接,GPO的输出信号作为GPIO的输入信号。PC接收来自被测设备上报的第一信息,第一信息包括第二电平;当第一电平与第二电平相一致时,确定GPO功能正常。当第一电平与第二电平不一致时,确定GPO功能异常。
本实施例中,因为通过GPO与GPIO相连接,所以GPIO可以获取GPO的输出电平,通过比较GPIO获取的输出电平和预设输入电平之间的一致性,可以判断GPO功能是否异常,该方法可以在不借助其它设备的情况下,准确检测GPO的功能是否正常,能够节省测试成本,提高测试结果准确率。
在一种可能的设计中,第一电平和第二电平均为高电平;确定GPO功能正常之前,该方法还包括:PC向被测设备发送第三指令,第三指令用于控制被测设备上的GPO输出低电平;PC向被测设备发送第四指令,第四指令用于指示被测设备上的GPIO上报第二信息,其中,GPO与GPIO相连接,GPO的输出信号作为GPIO的输入信号;PC接收来自被测设备上报的第二信息,当第一电平与第二电平相一致,且当第二信息包括低电平时,确定GPO功能正常。
本实施例中,PC利用高电平和低电平两类电平,对GPO的高电平和低电平的输出结果进行检测,可以全面评估GPO的功能是否正常。
在一种可能的设计中,本发明还包括如下步骤,预先将一GPIO和一GPO通过治具顶针两两相连。
在一种可能的设计中,上位机和待测设备之间通过数据线连接。
第二方面,本申请实施例还提供一种电路板测试装置,该装置包括执行上述第一方面的任意一种可能的设计的方法的模块/单元。这些模块/单元可以通过硬件实现,也可以通过硬件执行相应的软件实现。
第三方面,本申请实施例提供一种电子设备,包括处理器和存储器。其中,存储器用于存储一个或多个计算机程序;当存储器存储的一个或多个计算机程序被处理器执行时,使得该终端设备能够实现上述第二方面的任意一种可能的设计的方法。
第四方面,本申请实施例中还提供一种计算机可读存储介质,计算机可读存储介质包括计算机程序,当计算机程序在电子设备上运行时,使得所述电子设备执行上述任一方面的任意一种可能的设计的方法。
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