[发明专利]存储器件及其制造方法在审
申请号: | 202110617652.X | 申请日: | 2021-05-31 |
公开(公告)号: | CN113394221A | 公开(公告)日: | 2021-09-14 |
发明(设计)人: | 何彦忠;吴咏捷;游嘉榕;魏惠娴;马礼修;后藤贤一;许秉诚 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
主分类号: | H01L27/11504 | 分类号: | H01L27/11504;H01L27/11507;H01L27/11509;H01L27/11514;H01L27/22;H01L27/24 |
代理公司: | 北京德恒律治知识产权代理有限公司 11409 | 代理人: | 章社杲;李伟 |
地址: | 中国台*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 存储 器件 及其 制造 方法 | ||
1.一种存储器件,包括:
衬底;
薄膜晶体管(TFT),设置在所述衬底上;以及
存储单元,设置在所述衬底上并且与所述薄膜晶体管重叠,
其中,所述薄膜晶体管被配置为选择性地向所述存储单元供电。
2.根据权利要求1所述的存储器件,其中,所述薄膜晶体管设置在所述衬底和所述存储单元之间。
3.根据权利要求2所述的存储器件,其中,所述存储单元包括:
顶部电极;
底部电极,与所述薄膜晶体管的漏电极接触;以及
数据存储层,设置在所述顶部电极与所述底部电极之间。
4.根据权利要求2所述的存储器件,其中,所述薄膜晶体管包括:
栅电极;
沟道层,设置在所述栅电极上方;
高k介电层,设置在所述栅电极与所述沟道层之间;以及
源电极和漏电极,设置在所述沟道层上方且位于所述栅电极的任一侧上。
5.根据权利要求1所述的存储器件,其中,所述存储单元不与形成在所述衬底中的控制元件电连接。
6.一种存储器件,包括:
衬底;
字线,设置在所述衬底上;
选择器层,设置在所述衬底上并且包括与所述字线重叠的沟道区;以及
存储单元,与所述选择器层重叠并且电连接到所述选择器层,其中,所述存储单元设置在第一平面中,所述第一平面与平行于所述衬底的顶表面的平面平行。
7.根据权利要求6所述的存储器件,其中,所述选择器层包括:
高k介电层;以及
沟道层,设置在所述高k介电层上方并且包括所述沟道区。
8.根据权利要求7所述的存储器件,还包括:源电极和漏电极,交替设置在所述沟道层上,其中:
所述字线设置在所述高k介电层下方并且与所述沟道区重叠;
每个沟道区均设置在相应的一对源电极和漏电极之间;以及
每个存储单元均电连接至相应的漏电极。
9.一种形成存储器件的方法,包括:
在衬底上沉积和图案化字线;
在所述字线上方沉积选择器层;
在所述选择器层上交替地形成源电极和漏电极;
在所述漏电极上形成存储单元;以及
在所述存储单元上形成位线。
10.根据权利要求9所述的方法,其中,在所述字线上沉积所述选择器层包括:
在所述字线上方沉积高k介电层;以及
在所述高k层上沉积沟道层,所述沟道层包括与所述字线重叠的沟道区。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的