[发明专利]一种地址转换方法、装置、设备及机器可读存储介质在审

专利信息
申请号: 202110594148.2 申请日: 2021-05-28
公开(公告)号: CN113542445A 公开(公告)日: 2021-10-22
发明(设计)人: 王柏鹤 申请(专利权)人: 新华三信息安全技术有限公司
主分类号: H04L29/12 分类号: H04L29/12
代理公司: 暂无信息 代理人: 暂无信息
地址: 230001 安徽省合肥市高新区*** 国省代码: 安徽;34
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摘要:
搜索关键词: 一种 地址 转换 方法 装置 设备 机器 可读 存储 介质
【说明书】:

本公开提供一种地址转换方法、装置、设备及机器可读存储介质,该方法包括:接收待处理报文,查询本地与所述待处理报文匹配的会话信息;根据与所述待处理报文匹配的会话信息,对所述待处理报文进行地址转换;将经过地址转换的报文进行根据转换后的目的IP地址进行转发;所述会话信息是根据CPU下发的会话信息保存的。通过本公开的技术方案,使用专门的FPGA,根据CPU下发的会话信息,对关联匹配的待处理报文进行地址转换,并将转换后的报文进行转发,避免CPU在地址转换上消耗过大性能,同时利用了FPGA数倍于CPU的地址转换报文转发性能,提高AFT设备的处理效率。

技术领域

本公开涉及通信技术领域,尤其是涉及一种地址转换方法、装置、设备及机器可读存储介质。

背景技术

IPv4技术已经诞生了数十个年头,IPv4设计时采用的是32bit长度。理论上可以提供2的32次方个也就是43亿个IP地址。但是随着设备数量的快速增长。IPv4已经不能满足目前的需求。IPv6地址有2的128次方个。但是由于现在的一些硬件兼容性、软件兼容性,等问题无法立即普及IPv6。目前的NAT技术仅仅只能进行IPv4的地址之间进行转换。目前一些互联网公司的网站地址已经变成了IPv6地址。如果用户的终端不是IPv6的设备将无法访问。

CPU(central processing unit,中央处理器)作为计算机系统的运算和控制核心,是信息处理、程序运行的最终执行单元。

FPGA(Field Programmable Gate Array,现场可编程逻辑门阵列)是在PAL、GAL等可编程器件的基础上进一步发展的产物。它是作为专用集成电路(ASIC)领域中的一种半定制电路而出现的,既解决了定制电路的不足,又克服了原有可编程器件门电路数有限的缺点。

在AFT(Address Family Translation,地址族转换)设备中,通常CPU用于进行地址转换,通过在设备上配置对应的策略,配置的策略可以是变换源ip地址、目的ip地址、源端口号、目的端口号。流量上送到AFT设备上。根据报文五元组信息去配置对应的策略,如果匹配上了会根据对应的策略进行地址转换。现有技术一般是报文的解析和策略的配置和报文地址转换都是在CPU上进行的,这种方式的缺点是CPU低报文的转发能力比较弱,如果报文解析、策略匹配和地址转换都是在CPU上进行的转换,会是降低CPU低性能。

发明内容

有鉴于此,本公开提供一种地址转换方法、装置及电子设备、机器可读存储介质,以改善上述IPv4、IPv6地址消耗CPU性能过大的问题。

具体地技术方案如下:

本公开提供了一种地址转换方法,应用于AFT设备的FPGA,所述AFT设备还包括CPU,所述方法包括:接收待处理报文,查询本地与所述待处理报文匹配的会话信息;根据与所述待处理报文匹配的会话信息,对所述待处理报文进行地址转换;将经过地址转换的报文进行根据转换后的目的IP地址进行转发;所述会话信息是根据CPU下发的会话信息保存的。

作为一种技术方案,所述接收待处理报文,查询本地与所述待处理报文匹配的会话信息,包括:若本地未查询到与所述待处理报文匹配的会话信息,则将所述待处理报文上送至CPU;接收并保存CPU根据所述被上送的待处理报文下发的会话信息。

作为一种技术方案,所述若本地未查询到与所述待处理报文匹配的会话信息,则将所述待处理报文上送至CPU,包括:通过报文上送通道将所述待处理报文上送至CPU;所述接收并保存CPU根据所述被上送的待处理报文下发的会话信息,包括:通过会话下刷通道接收CPU下发的会话信息;所述报文上送通道和会话下刷通道是预先与CPU建立的。

作为一种技术方案,所述会话信息是根据CPU下发的会话信息保存的,包括:所述CPU下发的会话信息,是CPU根据待处理报文进行地址转换并预查到路由信息后,记录的映射信息生成的会话信息。

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