[发明专利]像素驱动电路、像素驱动电路的驱动方法和显示面板在审
申请号: | 202110541861.0 | 申请日: | 2021-05-18 |
公开(公告)号: | CN113192461A | 公开(公告)日: | 2021-07-30 |
发明(设计)人: | 郭子栋;郭恩卿 | 申请(专利权)人: | 云谷(固安)科技有限公司 |
主分类号: | G09G3/3208 | 分类号: | G09G3/3208;G09G3/3291;G09G3/32 |
代理公司: | 北京远智汇知识产权代理有限公司 11659 | 代理人: | 范坤坤 |
地址: | 065500 河*** | 国省代码: | 河北;13 |
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摘要: | |||
搜索关键词: | 像素 驱动 电路 方法 显示 面板 | ||
1.一种像素驱动电路,其特征在于,包括初始化模块、数据写入模块、第一驱动模块、第一存储模块、第二驱动模块、第二存储模块、发光控制模块和发光模块;
所述初始化模块用于对所述第一驱动模块的控制端进行初始化,所述数据写入模块用于向所述第一驱动模块的控制端写入数据电压,所述第一存储模块用于维持所述第一驱动模块的控制端电位;所述发光控制模块用于将所述第一驱动模块的控制端电位传输至所述第二驱动模块的控制端,所述第二存储模块用于维持所述第二驱动模块的控制端电位,所述第二驱动模块用于根据所述控制端的电位驱动发光模块发光。
2.根据权利要求1所述的像素驱动电路,其特征在于,所述发光控制模块包括第一晶体管,所述第一晶体管的栅极与发光控制信号输入端连接,所述第一晶体管的第一极与所述第一驱动模块的控制端连接,所述第二晶体管的第二极与所述第二驱动模块的控制端连接。
3.根据权利要求1或2所述的像素驱动电路,其特征在于,还包括补偿模块,所述补偿模块用于对所述第一驱动模块的阈值电压进行补偿。
4.根据权利要求3所述的像素驱动电路,其特征在于,所述第一驱动模块包括第二晶体管,所述第二驱动模块包括第三晶体管,所述第二晶体管和所述第三晶体管的沟道宽长比相等。
5.根据权利要求4所述的像素驱动电路,其特征在于,所述补偿模块包括第四晶体管,所述数据写入模块包括第五晶体管;所述发光控制模块还包括第六晶体管;所述第一存储模块包括第一存储电容,所述第二存储模块包括第二存储电容;所述发光模块包括发光器件;
所述第四晶体管的栅极和所述第五晶体管的栅极与第一扫描信号输入端连接,所述第四晶体管的第一极与所述第二晶体管的第二极连接,所述第四晶体管的第二极与所述第二晶体管的栅极连接,所述第五晶体管的第一极与数据电压输入端连接,所述第五晶体管的第二极与所述第二晶体管的第一极和所述第六晶体管的第二极连接,所述第六晶体管的栅极与发光控制信号输入端连接,所述第六晶体管的第一极、所述第一存储电容的第一极、所述第二存储电容的第一极和所述第三晶体管的第一极与第一电源信号输入端连接,所述第一存储电容的第二极与所述第二晶体管的栅极和所述第一晶体管的第一极连接,所述第二存储电容的第二极与所述第三晶体管的栅极和所述第一晶体管的第二极连接,所述第三晶体管的第二极与所述发光器件的阳极连接,所述发光器件的阴极与第二电源信号输入端连接。
6.根据权利要求5所述的像素驱动电路,其特征在于,所述初始化模块包括第七晶体管;所述第七晶体管的栅极与第零扫描信号输入端连接,所述第七晶体管的第一极与参考信号输入端连接,所述第七晶体管的第二极与所述第二晶体管的栅极连接。
7.根据权利要求6所述的像素驱动电路,其特征在于,还包括第八晶体管;所述第八晶体管的栅极与第二扫描信号输入端连接,所述第四晶体管的第二极和所述第七晶体管的第二极通过所述第八晶体管与所述第二晶体管的栅极连接。
8.根据权利要求7所述的像素驱动电路,其特征在于,所述第八晶体管为铟镓锌氧化物晶体管。
9.一种像素驱动电路的驱动方法,用于驱动权利要求1-8任一项所述的像素驱动电路;其特征在于,包括:
初始化阶段,初始化模块对第一驱动模块的控制端进行初始化;
数据写入阶段,数据写入模块向所述第一驱动模块的控制端写入数据电压,第一存储模块维持所述第一驱动模块的控制端电位;
发光阶段,发光控制模块将所述第一驱动模块的控制端电位传输至第二驱动模块的控制端,第二存储模块维持所述第二驱动模块的控制端电位,所述第二驱动模块根据所述控制端的电位驱动发光模块发光。
10.一种显示面板,其特征在于,包括权利要求1-8任一项所述的像素驱动电路。
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