[发明专利]图像传感器架构在审
| 申请号: | 202080027350.0 | 申请日: | 2020-03-30 |
| 公开(公告)号: | CN113647096A | 公开(公告)日: | 2021-11-12 |
| 发明(设计)人: | L.埃恩;V.C.卡尔代伊;C.W.克拉多克 | 申请(专利权)人: | 伟摩有限责任公司 |
| 主分类号: | H04N5/369 | 分类号: | H04N5/369;H04N5/225 |
| 代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 金玉洁 |
| 地址: | 美国加利*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 图像传感器 架构 | ||
1.一种图像传感器,包括:
第一集成电路层,包括基于位置分组成像素传感器群组的像素传感器;
与第一集成电路层电连通的第二集成电路层,所述第二集成电路层包括被配置为各自从对应像素传感器群组接收像素信息的图像处理电路群组,所述图像处理电路群组进一步被配置为在图像传感器的操作期间对像素信息执行图像处理操作以提供经处理像素信息;
与第二集成电路层电连通的第三集成电路层,所述第三集成电路层包括被配置为各自从对应图像处理电路群组接收经处理像素信息的神经网络电路群组,所述神经网络电路群组进一步被配置为在图像传感器的操作期间对经处理像素信息执行对象检测的分析;以及
电路,输出指示通过神经网络电路群组的对象检测的分析的结果的信息,
其中,第一集成电路层堆叠于第二集成电路层上,并且第二集成电路层堆叠于第三集成电路层上。
2.如权利要求1所述的图像传感器,其中,对象检测的分析的结果包括由以下各项组成的组中的至少一个:
表示检测的像素的选定所关注区域;
包含时间和几何位置信息的元数据;
在对象检测之前的中间计算结果;
关于网络确定性水平的统计信息;以及
检测对象的分类。
3.如权利要求1所述的图像传感器,其中,所述神经网络电路群组各自包括被配置为实施卷积神经网络的电路。
4.如权利要求1所述的图像传感器,其中,所述卷积神经网络各自检测由对应于与神经网络电路群组对应的图像处理电路群组的像素传感器群组感测的对象。
5.如权利要求1所述的图像传感器,其中,所述第三集成电路层包括被配置为实施循环神经网络的电路。
6.如权利要求1所述的图像传感器,其中,所述循环神经网络接收关于由全部神经网络电路群组检测的对象的信息,并检测跨所述像素传感器群组中的多个像素传感器群组感测的对象。
7.如权利要求1所述的图像传感器,其中,所述神经网络电路群组中的每一个定位于将经处理像素信息提供至神经网络电路群组的图像处理电路群组正下方。
8.如权利要求1所述的图像传感器,其中,所述图像处理电路群组中的每一个定位在将像素信息提供至图像处理电路群组的像素传感器群组正下方或紧邻将像素信息提供至图像处理电路群组的像素传感器群组。
9.如权利要求1所述的图像传感器,其中,所述第一集成电路层、所述第二集成电路层和所述第三集成电路层集成在单个集成芯片中。
10.如权利要求1所述的图像传感器,其中,所述像素传感器群组中的每一个包括相同数目的像素传感器。
11.如权利要求1所述的图像传感器,其中,对像素信息执行的图像处理操作包括在处理之前的高动态范围融合。
12.如权利要求1所述的图像传感器,其中,所述图像处理电路群组中的每一个包括模拟数字转换器。
13.一种方法,包括:
由在第一集成电路层中且基于位置分组成像素传感器群组的像素传感器获得像素信息;
由在与第一集成电路层电连通的第二集成电路层中的图像处理电路群组对来自对应像素传感器群组的像素信息执行图像处理操作以提供经处理像素信息;
由在与第二集成电路层电连通的第三集成电路层中的神经网络电路群组对来自对应图像处理电路群组的经处理像素信息执行对象检测的分析;以及
输出指示由神经网络电路群组进行的对象检测的分析的结果的信息,
其中,第一集成电路层堆叠于第二集成电路层上,并且第二集成电路层堆叠于第三集成电路层上。
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