[发明专利]数据传输方法和数据传输装置有效

专利信息
申请号: 202011353620.5 申请日: 2020-11-27
公开(公告)号: CN112506815B 公开(公告)日: 2023-01-31
发明(设计)人: 沈祥;卢一帆;李凯 申请(专利权)人: 成都海光微电子技术有限公司
主分类号: G06F12/1081 分类号: G06F12/1081;G06F13/28
代理公司: 北京市柳沈律师事务所 11105 代理人: 彭久云;王丽
地址: 610216 四川省成都市中国(四*** 国省代码: 四川;51
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摘要:
搜索关键词: 数据传输 方法 装置
【说明书】:

一种数据传输方法和数据传输装置。该数据传输方法包括:获取第一存储单元和第二存储单元的数据交换信息,数据交换信息包括第一存储单元的数据的第一源起始地址和第一传输数据量以及第二存储单元的数据的第二源起始地址和第二传输数据量,第一传输数据量的数据包括N个第一数据序列,第二传输数据量的数据包括M个第二数据序列;基于数据交换信息,从第一存储单元中读取N个第一数据序列至第一缓存单元,从第二存储单元中读取M个第二数据序列至第二缓存单元,在从第一存储单元中依次读取N个第一数据序列的过程中,从第二存储单元中依次读取M个第二数据序列;N和M为大于等于1的整数。该数据传输方法可以提高数据交换的效率。

技术领域

本公开的实施例涉及一种数据传输方法和数据传输装置。

背景技术

DMA(Direct Memory Access,直接内存存取)传输装置可以将数据从一个地址空间复制到另外一个地址空间。当中央处理单元(CPU)初始化这个传输动作时,传输动作本身是由DMA传输装置来实行和完成,例如,可以由DMA传输装置移动一个外部内存的区块到芯片内部的内存区。这样的操作并没有让CPU工作拖延,反而可以被重新安排去处理其他的工作,因此,DMA传输装置对于高效能嵌入式系统算法和网络是很重要的。

发明内容

本公开至少一实施例提供一种数据传输方法,应用于需要数据交换的系统中,所述数据传输方法包括:获取第一存储单元和第二存储单元的数据交换信息,其中,所述数据交换信息包括所述第一存储单元的数据的第一源起始地址和第一传输数据量以及所述第二存储单元的数据的第二源起始地址和第二传输数据量,所述第一传输数据量的数据包括N个第一数据序列,分为N次传输,所述第二传输数据量的数据包括M个第二数据序列,分为M次传输;基于所述数据交换信息,从所述第一存储单元中读取所述N个第一数据序列至第一缓存单元,从所述第二存储单元中读取所述M个第二数据序列至所述第二缓存单元,在从所述第一存储单元中依次读取所述N个第一数据序列的过程中,从所述第二存储单元中依次读取所述M个第二数据序列;N和M为大于等于1的整数。

例如,在本公开至少一实施例提供的数据传输方法中,基于所述数据交换信息,从所述第一存储单元中读取所述N个第一数据序列至第一缓存单元,从所述第二存储单元中读取所述M个第二数据序列至所述第二缓存单元,包括:判断是否有从所述第一存储单元中读取所述N个第一数据序列的第一读取数据请求;如果是,则发送所述第一读取数据请求至所述第一存储单元以从所述第一存储单元读取与所述第一读取数据请求对应的第一数据序列;如果否,则判断是否有从所述第二存储单元中读取所述M个第二数据序列的第二读取数据请求;如果是,则发送所述第二读取数据请求至所述第二存储单元以从所述第二存储单元读取与所述第二读取数据请求对应的第二数据序列;如果否,则继续判断是否有从所述第一存储单元中读取所述N个第一数据序列的第一读取数据请求,直至所述N个第一数据序列和所述M个第二数据序列全部读取完成。

例如,在本公开至少一实施例提供的数据传输方法中,所述第一源起始地址对应于第一个第一数据序列的第x位数据,所述第二源起始地址对应于第一个第二数据序列的第y位数据,基于所述数据交换信息,从所述第一存储单元中读取所述N个第一数据序列至第一缓存单元,从所述第二存储单元中读取所述M个第二数据序列至所述第二缓存单元,包括:在响应于第一读取数据请求返回所述第一个第一数据序列时,仅返回所述第一个第一数据序列包括的第x至第X-1位数据;在响应于第二读取数据请求返回所述第一个第二数据序列时,仅返回所述第一个第二数据序列包括的第y至第Y-1位数据;x为大于等于0且小于等于X-1的整数,X表示所述第一个第一数据序列的位宽,为大于等于1的整数;y为大于等于0且小于等于Y-1的整数,Y表示所述第一个第二数据序列的位宽,为大于等于1的整数。

例如,本公开至少一实施例提供的数据传输方法,还包括:在从所述第一存储单元中读取所述N个第一数据序列至第一缓存单元,从所述第二存储单元中读取所述M个第二数据序列至所述第二缓存单元过程中,从所述第一缓存单元中将所述N个第一数据序列依次写入至所述第二存储单元,从所述第二缓存单元中将所述M个第二数据序列依次写入至所述第一存储单元。

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