[发明专利]在存储器模块中累积且存储字线的存取次数的方法及设备在审

专利信息
申请号: 202011335141.0 申请日: 2020-11-25
公开(公告)号: CN112837729A 公开(公告)日: 2021-05-25
发明(设计)人: 王明弘;吴俊鹏 申请(专利权)人: 补丁科技股份有限公司
主分类号: G11C11/408 分类号: G11C11/408;G11C11/407;H03K23/56
代理公司: 深圳新创友知识产权代理有限公司 44223 代理人: 江耀纯
地址: 中国台*** 国省代码: 台湾;71
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摘要:
搜索关键词: 存储器 模块 累积 存储 存取 次数 方法 设备
【权利要求书】:

1.一种用于在一存储器模块中累积并且存储复数个字线的各自的存取次数的设备,其特征在于,该设备包括:

一存储器库,位于该存储器模块中,用来为一主机系统存储数据,该存储器库包括:

复数个超凡存储细胞,耦接至该复数个字线,用来累积并存储该复数个字线的该各自的存取次数,其中在该复数个超凡存储细胞中的多组超凡存储细胞分别对应于该复数个字线。

2.如权利要求1所述的设备,其特征在于,该存储器库还包括:

一计数器,耦接至该复数个超凡存储细胞,用来进行计数;以及

包括至少一控制电路的一字线存取次数控制单元,耦接至该计数器,用来控制该设备的运作,其中:

响应于该复数个字线的任一字线被存取,该字线存取次数控制单元控制该计数器读出在所述任一字线上的一组超凡存储细胞中的一组比特信息;

该计数器更新该组比特信息所指出的一计数值以产生一更新后计数值;以及

该字线存取次数控制单元触发将用以指出该更新后计数值的一组更新后比特信息写回在所述任一字线上的该组超凡存储细胞,以作为所述任一字线的一存取次数的一更新后数值。

3.如权利要求2所述的设备,其特征在于,该存储器库还包括:

复数个超凡比特线,耦接至该复数个超凡存储细胞;以及

一超凡页面缓冲器,通过该复数个超凡比特线耦接至该复数个超凡存储细胞,其中该超凡页面缓冲器锁存该组比特信息,以供被加载至该计数器以作为该计数值;

其中:

于读出该组比特信息的期间,该字线存取次数控制单元利用该计数器自该超凡页面缓冲器读取该组比特信息,其中载有该组比特信息的细胞信号是通过电荷共享自于所述任一字线上的该组超凡存储细胞被传送至该复数个超凡比特线,以及该组比特信息是被该超凡页面缓冲器锁存;以及

于写入该组更新后比特信息的期间,该字线存取次数控制单元利用该计数器将用以指出该更新后计数值的该组更新后比特信息写入该超凡页面缓冲器,以供将该组更新后比特信息写回在所述任一字线上的该组超凡存储细胞,其中该超凡页面缓冲器通过该复数个超凡比特线将用以指出该更新后计数值的该组更新后比特信息驱动回在所述任一字线上的该组超凡存储细胞,以作为所述任一字线的该存取次数的该更新后数值,以及载有该组更新后比特信息的细胞信号是自该复数个超凡比特线被传送至于所述任一字线上的该组超凡存储细胞。

4.如权利要求3所述的设备,其特征在于,在该多组超凡存储细胞的每一组中的存储细胞的数量等于N,其中N代表一正整数;以及该超凡页面缓冲器是一X比特超凡页面缓冲器,其中X代表大于或等于N的一正整数。

5.如权利要求2所述的设备,其特征在于,在该多组超凡存储细胞的每一组中的存储细胞的数量等于N,其中N代表一正整数;以及该计数器是一X比特计数器,其中X代表大于或等于N的一正整数。

6.如权利要求2所述的设备,其特征在于,更新该计数值包括增加该计数值或减少该计数值;以及响应于该计数值达到一预定计数值阈,该字线存取次数控制单元通过复位该计数值产生该更新后计数值,并且产生一警示。

7.如权利要求2所述的设备,其特征在于,该字线存取次数控制单元在不被来自该主机系统的任一外部指令触发的情况下自动地运作,以控制该存储器模块的一系列运作,其中该系列运作包括更新由该组比特信息所指出的该计数值以产生该更新后计数值的运作、以及将用以指出该更新后计数值的该组更新后比特信息写回在所述任一字线上的该组超凡存储细胞以作为所述任一字线的该存取次数的该更新后数值的运作。

8.如权利要求7所述的设备,其特征在于,该字线存取次数控制单元在一最小行活跃时间内完成该系列运作的全部运作。

9.如权利要求2所述的设备,其特征在于,该字线存取次数控制单元依据由本身来控制的自我时序来控制该存储器模块的一系列运作。

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