[发明专利]一种集成肖特基结构温度传感器的MOSFET器件及其制备方法在审
申请号: | 202011322781.8 | 申请日: | 2020-11-23 |
公开(公告)号: | CN114530376A | 公开(公告)日: | 2022-05-24 |
发明(设计)人: | 李鑫 | 申请(专利权)人: | 瑶芯微电子科技(上海)有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L23/34;H01L29/78 |
代理公司: | 西安嘉思特知识产权代理事务所(普通合伙) 61230 | 代理人: | 刘长春 |
地址: | 200120 上海市浦东新区中国(上海*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 集成 肖特基 结构 温度传感器 mosfet 器件 及其 制备 方法 | ||
1.一种集成肖特基结构温度传感器的MOSFET器件的制备方法,其特征在于,包括以下步骤:
选取N型衬底层(1);
在所述N型衬底层(1)上形成N型外延层(2);
在所述N型外延层(2)的两端的内表面形成两个P阱注入区(3);
在所述P阱注入区(3)的内表面形成N+注入区(4);
在所述P阱注入区(3)的内表面形成P+注入区(5),其中,两个所述N+注入区(4)位于两个所述P+注入区(5)之间;
在部分所述N型外延层(2)、部分所述P阱注入区(3)和部分所述N+注入区(4)上形成第一栅氧化层(6)和第二栅氧化层(7);
在所述P+注入区(5)和部分所述N+注入区(4)上形成源极(8);
在所述N型衬底层(1)的下表面形成漏极(9);
在所述N型外延层(2)上形成复合金属层(10),所述复合金属层(10)与所述N型外延层(2)为肖特基接触,且所述复合金属层(10)位于所述第一栅氧化层(6)和所述第二栅氧化层(7)之间;
在所述第一栅氧化层(6)和所述第二栅氧化层(7)上形成栅极(11)。
2.根据权利要求1所述的制备方法,其特征在于,所述N型衬底层(1)为N型4H-SiC衬底层,所述N型外延层(2)为N型4H-SiC外延层。
3.根据权利要求1所述的制备方法,其特征在于,在所述N型外延层(2)的两端的内表面形成两个P阱注入区(3),包括:
利用离子注入方法在所述N型外延层(2)的两端的内表面注入Al离子形成两个P阱注入区(3)。
4.根据权利要求1所述的制备方法,其特征在于,在所述P阱注入区(3)的内表面形成N+注入区(4),包括:
利用离子注入方法在所述P阱注入区(3)的内表面注入N离子形成N+注入区(4)。
5.根据权利要求1所述的制备方法,其特征在于,在所述P阱注入区(3)的内表面形成P+注入区(5),包括:
利用离子注入方法在所述P阱注入区(3)的内表面注入Al离子形成P+注入区(5)。
6.根据权利要求1所述的制备方法,其特征在于,在所述N型外延层(2)上形成复合金属层(10),包括:
利用磁控溅射或电子束蒸发方法在所述N型外延层(2)上形成复合金属层(10)。
7.根据权利要求1所述的制备方法,其特征在于,所述复合金属层(10)包括W层和TiN层,所述W层位于所述N型外延层(2)之上,所述TiN层位于所述W层之上。
8.根据权利要求7所述的制备方法,其特征在于,所述W层的厚度为150~200nm,TiN层的厚度为200nm。
9.根据权利要求1所述的制备方法,其特征在于,在所述N型衬底层(1)的下表面形成漏极(9)之后,还包括:
对所形成的N型衬底层(1)、所述N型外延层(2)、所述P阱注入区(3)、所述N+注入区(4)、所述P+注入区(5)、所述第一栅氧化层(6)和所述第二栅氧化层(7)、所述源极(8)和所述漏极(9)进行快速热退火处理。
10.一种集成肖特基结构温度传感器的MOSFET器件,其特征在于,所述集成肖特基结构温度传感器的MOSFET器件由权利要求1~9任一项所述的制备方法制备形成,所述MOSFET器件包括:
N型衬底层(1);
N型外延层(2),位于所述N型衬底层(1)之上;
两个P阱注入区(3),分别位于所述N型外延层(2)的两端内;
两个N+注入区(4),分别位于两个所述P阱注入区(3)内;
两个P+注入区(5),分别位于两个所述P阱注入区(3)内,且两个所述N+注入区(4)位于两个所述P+注入区(5)之间;
第一栅氧化层(6)、第二栅氧化层(7),分别位于部分所述N型外延层(2)、部分所述P阱注入区(3)和部分所述N+注入区(5)之上;
两个源极(8),分别位于处于两端的所述P+注入区(5)和部分所述N+注入区(4)之上;
漏极(9),位于所述N型衬底层(1)的下表面;
复合金属层(10),位于所述N型外延层(2)之上,所述复合金属层(10)与所述N型外延层(2)为肖特基接触,且所述复合金属层(10)位于所述第一栅氧化层(6)和所述第二栅氧化层(7)之间;
两个栅极(11),分别位于所述第一栅氧化层(6)、所述第二栅氧化层(7)之上。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造