[发明专利]位串转换有效
申请号: | 202010836331.4 | 申请日: | 2020-08-19 |
公开(公告)号: | CN112420092B | 公开(公告)日: | 2021-11-23 |
发明(设计)人: | V·S·拉梅什;K·B·帕克 | 申请(专利权)人: | 美光科技公司 |
主分类号: | G11C7/10 | 分类号: | G11C7/10;H03M9/00 |
代理公司: | 北京律盟知识产权代理有限责任公司 11287 | 代理人: | 王龙 |
地址: | 美国爱*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 转换 | ||
描述与位串转换相关的系统、设备和方法。电路系统可以对例如通用数和/或posit位串的位串执行运算以更改位串的精确度水平(例如,动态范围、分辨率等)。例如,位串转换可以包含通过耦合到逻辑电路系统的存储器资源接收具有第一位串长度的第一位串。所述第一位量可以包括第一位子集、第二位子集、第三位子集和第四位子集。所述逻辑电路系统监测与所述位串的至少一个位子集相对应的数值以确定与所述数据相对应的动态范围和/或与所述数据相对应的精确度,并且至少部分地基于所确定的所述数据的动态范围、所述数据的所述精确度而生成具有第二位串长度的第二位串。
技术领域
本公开大体上涉及半导体存储器和方法,且更确切地,涉及用于位串转换的设备、系统和方法。
背景技术
存储器装置通常提供为计算机或其它电子系统中的内部半导体集成电路。存在许多不同类型的存储器,包含易失性和非易失性存储器。易失性存储器会需要功率以维持其数据(例如主机数据、误差数据等等),并包含随机存取存储器(RAM)、动态随机存取存储器(DRAM)、静态随机存取存储器(SRAM)、同步动态随机存取存储器(SDRAM)和闸流体随机存取存储器(TRAM)等等。非易失性存储器可通过在未供电时保存所存储数据来提供永久数据,且可以包含NAND快闪存储器、NOR快闪存储器和电阻可变存储器,例如相变随机存取存储器(PCRAM)、电阻性随机存取存储器(RRAM)和磁阻随机存取存储器(MRAM),例如自旋力矩传送随机存取存储器(STT RAM)等等。
存储器装置可耦合到主机(例如,主机计算装置)以存储数据、命令和/或指令以在计算机或电子系统处于运算中时供主机使用。例如,数据、命令和/或指令可在计算或其它电子系统的运算期间在主机与存储器装置之间传送。
发明内容
在一个方面,本申请提供一种用于位串转换的方法,其包括:通过耦合到逻辑电路系统122、222、522的存储器资源124、224、524接收包括具有第一位串长度的第一位串331、631-1的数据,其中第一位量包括第一位子集333、633、第二位子集335、635、第三位子集337、637和第四位子集339、639;通过所述逻辑电路系统122、222、522监测与所述位串331、631-1的至少一个位子集333、335、337、339相对应的数值,以确定与所述数据相对应的动态范围、与所述数据相对应的精确度或两者;以及至少部分地基于所确定的所述数据的动态范围、所述数据的所述精确度或两者,通过增大或减小所述第一位串331、631-1的位量、与所述第一位串331、631-1的至少一个位子集333、335、337、339相对应的数值或两者而进行更改以生成具有第二位串长度的第二位串331、631-2。
在另一方面,本申请提供一种用于位串转换的设备,其包括:存储器资源124、224、524,其经配置以接收包括具有与第一位串长度相对应的第一位量的位串331、631-1的数据;以及逻辑电路系统122、222、522,其耦合到所述存储器资源,其中所述逻辑电路系统122、222、522经配置以:监测与所述位串331、631-1的至少一个位子集333、335、337、339、6533、635、637、639相对应的数值,以确定与所述数据相对应的动态范围、与所述数据相对应的精确度或两者;以及至少部分地基于所确定的所述数据的动态范围、所述数据的所述精确度或两者,将所述第一位量更改为与第二位串长度相对应的第二位量;以及寄存器213,其耦合到所述逻辑电路系统122、222、522,其中所述寄存器213经配置以:存储与所述第一位串331、631-1的相应位子集333、335、337、339、6533、635、637、639相对应的类别间隔信息,所述类别间隔信息包含与对应于所述第一位串331、631-1的所述相应位子集333、335、337、339、6533、635、637、639的位量相关联的所述数值;以及响应于由所述逻辑电路系统122、222、522生成的指令而提供对所述类别间隔信息的存取,以确定与所述数据相对应的所述动态范围、所述数据的所述精确度或两者。
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