[发明专利]用于存储器装置中的时钟信号对准的方法以及采用所述方法的存储器装置及系统在审

专利信息
申请号: 202010572946.0 申请日: 2020-06-22
公开(公告)号: CN112289349A 公开(公告)日: 2021-01-29
发明(设计)人: R·K·理查兹;D·卡特里 申请(专利权)人: 美光科技公司
主分类号: G11C7/22 分类号: G11C7/22
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 王龙
地址: 美国爱*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 存储器 装置 中的 时钟 信号 对准 方法 以及 采用 系统
【说明书】:

本申请案涉及用于存储器装置中的时钟信号对准的方法以及采用所述方法的存储器装置及系统。存储器模块或电子系统的存储器装置或其它组件可使经接收时钟信号偏移。例如,所述存储器装置可接收具有用于系统的标称操作速度或频率的时钟信号,且所述存储器装置可基于其它操作因素(例如其它信号的速度或频率、物理约束、从主机装置接收的指示等)调整所述时钟信号或使所述时钟信号偏移。时钟偏移值可基于例如命令/地址信令的传播。在一些实例中,存储器模块可包含可管理或协调所述模块上的各种存储器装置当中或之间的时钟偏移的寄存时钟驱动器RCD、集线器或本地控制器。时钟偏移值可经编程到模式寄存器或若干模式寄存器。

技术领域

发明大体上涉及半导体存储器装置,且更特定来说,涉及用于存储器装置中的时钟信号对准的方法以及采用所述方法的存储器装置及系统。

背景技术

存储器装置广泛地用于存储与例如计算机、无线通信装置、相机、数字显示器等的各种电子装置相关的信息。通过对存储器单元的不同状态进行编程来存储信息。存在各种类型的存储器装置,包含磁性硬盘、随机存取存储器(RAM)、只读存储器(ROM)、静态RAM(SRAM)、动态RAM(DRAM)、同步动态RAM(SDRAM)等。存储器装置可为易失性的或非易失性的。改进存储器装置通常可包含增加存储器单元密度,增加读取/写入速度或以其它方式减少操作时延,增加可靠性,增加数据保留,减少功耗或降低制造成本,以及其它度量。

发明内容

根据本申请案的一方面,提供一种设备。所述设备包括:多个存储器装置;时钟树,其经配置以将时钟信号传播到所述存储器装置中的每一者;及命令/地址总线,其经耦合到所述存储器装置中的每一者且经配置以将命令/地址信号传输到所述存储器装置中的每一者;其中所述多个存储器装置中的第一存储器装置经配置以:确定所述第一存储器装置的操作速度,基于所述经确定速度从多个时钟偏移值选择时钟偏移值,及使在所述存储器装置处从所述时钟树接收的所述时钟信号偏移达所述选定时钟偏移值。

根据本申请案的另一方面,提供一种设备。所述设备包括:经配置以确定存储器装置是在第一速度下还是在与所述第一速度不同的第二速度下操作的电路;及经配置以进行以下操作的电路:响应于确定所述存储器装置在所述第一速度下操作,使经接收时钟信号偏移达对应于所述第一速度的第一量,且响应于确定所述存储器装置在所述第二速度下操作,使所述经接收时钟信号偏移达对应于所述第二速度的第二量。

根据本申请案的又一方面,提供一种方法。所述方法包括:确定存储器装置的操作速度;基于所述经确定速度从多个时钟偏移值选择用于所述存储器装置的时钟偏移值;及使在所述存储器装置处接收的时钟信号偏移达所述选定时钟偏移值。

附图说明

图1是示意性地说明根据本技术的实施例的存储器装置的简化框图。

图2是示意性地说明根据本技术的实施例的存储器模块的简化框图。

图3是示意性地说明根据本技术的实施例的存储器模块的时钟树的简化框图。

图4是示意性地说明根据本技术的实施例的存储器模块的命令/地址总线的简化框图。

图5是示意性地说明根据本技术的实施例的在实施时钟偏移之前在存储器装置处接收的时钟信号及命令/地址信号的失准的简化示意性数据眼图。

图6是示意性地说明根据本技术的实施例的存储器装置内的时钟信号及命令/地址信号的对准的简化示意性数据眼图。

图7是示意性地说明根据本技术的实施例的存储器系统的简化框图。

图8是说明根据本技术的实施例的操作存储器系统的方法的流程图。

图9是说明根据本技术的实施例的操作存储器装置的方法的流程图。

具体实施方式

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