[发明专利]DC-DC转换器在审
申请号: | 202010503708.4 | 申请日: | 2020-06-05 |
公开(公告)号: | CN112152439A | 公开(公告)日: | 2020-12-29 |
发明(设计)人: | 张嘉峻;艾伦罗斯;艾力克苏宁;徐英智 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
主分类号: | H02M1/38 | 分类号: | H02M1/38;H02M1/08 |
代理公司: | 南京正联知识产权代理有限公司 32243 | 代理人: | 顾伯兴 |
地址: | 中国台湾新竹科*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | dc 转换器 | ||
本发明提供一种DC‑DC转换器。DC‑DC转换器包含功率级、误差放大器、脉冲宽度调制(PWM)产生器以及栅极控制器。功率级包含第一晶体管和第二晶体管。功率级配置成产生第一节点处的输出。误差放大器配置成从第一节点接收输出且产生误差信号。脉冲宽度调制产生器配置成从误差放大器接收误差信号且产生脉冲宽度调制信号。栅极控制器包含多个分压器和比较器。分压器配置成对第一节点和第二节点执行分压以产生第一电压和第二电压。第一节点是DC‑DC转换器的输出节点且第二节点是DC‑DC转换器的第一晶体管与第二晶体管之间的节点。比较器配置成将第一电压与第二电压进行比较以根据比较结果来产生第一晶体管的接通时间信号。
技术领域
本发明的实施例是有关于转换器,且特别是有关于一种DC-DC转换器。
背景技术
在DC-DC转换器中,良好计时栅极控制对于在功率MOS切换期间使死区时间最小化来说是优选的,这在体二极管传导期间减少断电。通过使用取样/保持电路来检测死区时间,又引起低切换频率下的泄漏。在另一方面中,确立DC-DC转换器的预校准以使死区时间最小化,但死区时间可相对于大的输入电压和变化的负载条件而改变。另外,DC-DC转换器的预校准需要额外引脚,这增加封装成本。在一些架构中,通过感测输出级的栅极电压来控制死区时间,保留用于感测的保护频带的结果可使得增加死区时间。
因此,需要在DC-DC转换器中设计在功率MOS切换期间具有最小死区时间的良好计时栅极控制。
发明内容
本发明实施例提供一种DC-DC转换器,包括:功率级,包括第一晶体管和第二晶体管,其中所述功率级配置成产生第一节点处的输出;误差放大器,配置成从所述第一节点接收所述输出且产生误差信号;脉冲宽度调制产生器,配置成从所述误差放大器接收所述误差信号且产生脉冲宽度调制信号;以及栅极控制器,包括:多个分压器,配置成对所述第一节点和第二节点执行分压以产生第一电压和第二电压,其中所述第一节点是所述DC-DC转换器的输出节点且所述第二节点是所述DC-DC转换器的所述第一晶体管与所述第二晶体管之间的节点;以及比较器,配置成将所述第一电压与所述第二电压进行比较以根据比较结果来产生所述第一晶体管的接通时间信号。
附图说明
当结合附图阅读时,从以下详细描述最好地理解本公开的方面。应注意,根据业界中的标准惯例,各个特征未按比例绘制。实际上,为了论述清楚起见,可任意增大或减小各个特征的尺寸。
图1说明根据本公开的示范性实施例的DC-DC转换器的方块图。
图2说明根据本公开的示范性实施例的DC-DC转换器的方块图。
图3说明根据本公开的示范性实施例的自计时栅极控制器的示意性电路图。
图4说明根据本公开的示范性实施例的DC-DC转换器的操作波形。
图5说明根据本公开的另一示范性实施例的自计时栅极控制器的示意性电路图。
图6说明根据本公开的示范性实施例的自计时栅极控制器的示意性电路图。
图7说明用于说明根据本公开的示范性实施例的DC-DC转换器操作方法的流程图。
图8说明用于说明根据本公开的示范性实施例的DC-DC转换器操作方法的流程图。
具体实施方式
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