[发明专利]用于存储器阵列数据结构正数运算的设备、系统及方法在审

专利信息
申请号: 202010190596.1 申请日: 2020-03-18
公开(公告)号: CN111724832A 公开(公告)日: 2020-09-29
发明(设计)人: V·S·拉梅什 申请(专利权)人: 美光科技公司
主分类号: G11C7/10 分类号: G11C7/10;G11C11/409;H03M9/00
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 王龙
地址: 美国爱*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 存储器 阵列 数据结构 正数 运算 设备 系统 方法
【权利要求书】:

1.一种用于存储器阵列数据结构正数运算的方法,其包括使用存储在存储器阵列(130;230;630;730)中的第一通用数字位串及存储在所述存储器阵列(130;230;630;730)中的第二通用数字unum位串执行算术运算或逻辑运算或两者。

2.根据权利要求1所述的用于存储器阵列数据结构正数运算的方法,其进一步包括:

使用耦合到所述存储器阵列(130;230;630;730)的处理装置执行第一转换运算以从第一浮点位串产生所述第一unum位串;

使用耦合到所述存储器阵列(130;230;630;730)的处理装置执行第二转换运算以从第二浮点位串产生所述第二unum位串;及

致使在使用所述第一unum位串及所述第二unum位串执行所述算术运算或所述逻辑运算或两者之前,将所述第一unum位串及所述第二unum位串存储在所述存储器阵列(130;230;630;730)中。

3.根据权利要求2所述的用于存储器阵列数据结构正数运算的方法,其中致使将所述第一unum位串及所述第二unum位串存储在所述存储器阵列(130;230;630;730)中进一步包括经由耦合到所述存储器阵列(130;230;630;730)的多个共享输入/输出线将所述第一unum位串及所述第二unum位串从所述处理装置传送到所述存储器阵列(130;230;630;730)。

4.根据权利要求1到2中任一权利要求所述的用于存储器阵列数据结构正数运算的方法,其进一步包括执行所述算术运算或所述逻辑运算或两者而无需将所述第一unum位串或所述第二unum位串传送到所述存储器阵列(130;230;630;730)外部的电路。

5.根据权利要求1到2中任一权利要求所述的用于存储器阵列数据结构正数运算的方法,其进一步包括:

确定所述算术运算或所述逻辑运算或两者需要第三unum位串,所述第三unum位串具有大于所述第一unum位串及所述第二unum位串的位长的位长;

使用所述处理装置产生所述第三unum位串;及

使用所述处理装置执行所述算术运算或所述逻辑运算或两者。

6.根据权利要求1到2中任一权利要求所述的用于存储器阵列数据结构正数运算的方法,其进一步包括对存储在三晶体管3T存储器阵列(730)中的第一unum位串及存储在所述3T存储器阵列(730)中的第二unum位串执行所述算术运算或所述逻辑运算或两者。

7.根据权利要求1到2中任一权利要求所述的用于存储器阵列数据结构正数运算的方法,其进一步包括对存储在动态随机存取DRAM存储器阵列中的第一unum位串及存储在所述DRAM存储器阵列中的第二unum位串执行所述算术运算或所述逻辑运算或两者。

8.一种用于存储器阵列数据结构正数运算的方法,其包括:

使用耦合到存储器阵列(130;230;630;730)的电路(120;220;520)确定所述存储器阵列(130;230;630;730)中存储对应于算术运算或逻辑运算或两者的结果的正数位串的地址位置;

使用所述电路(120;220;520)产生检索对应于所述算术运算或所述逻辑运算或两者的所述结果的所述正数位串的命令;及

致使将所述算术运算或所述逻辑运算或两者的所述结果传送到所述存储器阵列(130;230;630;730)外部的电路。

9.根据权利要求8所述的用于存储器阵列数据结构正数运算的方法,其进一步包括响应于检索对应于所述算术运算或所述逻辑运算或两者的所述结果的所述正数位串的所述命令而从存储在所述存储器阵列(130;230;630;730)中的数据结构(634)检索所述算术运算或所述逻辑运算或两者的所述结果。

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