[发明专利]一种FPGA中配置控制器验证方法、系统及设备有效
| 申请号: | 202010177042.8 | 申请日: | 2020-03-13 | 
| 公开(公告)号: | CN111352025B | 公开(公告)日: | 2020-12-11 | 
| 发明(设计)人: | 高晓倩;王潘丰;崔运东;王海力 | 申请(专利权)人: | 京微齐力(深圳)科技有限公司 | 
| 主分类号: | G01R31/3185 | 分类号: | G01R31/3185;G01R31/317 | 
| 代理公司: | 暂无信息 | 代理人: | 暂无信息 | 
| 地址: | 518057 广东省深圳市南山区粤海街*** | 国省代码: | 广东;44 | 
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| 摘要: | |||
| 搜索关键词: | 一种 fpga 配置 控制器 验证 方法 系统 设备 | ||
1.一种FPGA中配置控制器验证方法,其特征在于,所述方法包括:
采集FPGA配置信息并生成包含循环冗余校验字段的第一码流;
对所述第一码流进行修改,在码流结构中修改循环冗余校验赋值,形成循环冗余校验不使能,并缩短码流长度,生成第二码流;
向所述配置控制器中送入所述第二码流和采样模式脚,进行第一验证,在所述第一验证中,旁路循环冗余校验;及
当所述第一验证通过后,向所述配置控制器中送入所述第一码流和采样模式脚,进行第二验证,单独验证循环冗余校验使能后是否正确;
所述第一码流包括具有完整验证功能码流结构的全码流,所述全码流的码流结构包括:依次排列的空字字段、初始帧同步字字段、设置配置寄存器值字段、加载第一配置数据字段、循环冗余校验字段和完成加载第一配置链组结束信号字段;
所述全码流经修改后生成的第二码流的码流结构包括:依次排列的空字字段、初始帧同步字字段、设置配置寄存器值字段、旁路循环冗余校验字段、加载由第一配置数据缩短码流后形成的第二配置数据字段和完成加载第二配置链组结束信号字段。
2.如权利要求1所述一种FPGA中配置控制器验证方法,其特征在于,在向所述配置控制器中送入所述第二码流和采样模式脚之前,所述方法还包括:
完成上电;
待所述配置控制器内配置寄存器清空后接收第一清空标志信号。
3.如权利要求2所述一种FPGA中配置控制器验证方法,其特征在于,在向所述配置控制器中送入所述第一码流和采样模式脚之前,所述方法还包括:
完成上电;
待所述配置控制器内配置寄存器清空后接收第二清空标志信号。
4.如权利要求1所述一种FPGA中配置控制器验证方法,其特征在于,所述第一验证包括:
根据所述采样模式脚的M赋值识别FPGA配置模式,M赋值为0时,为主动配置模式,M赋值为1时,为被动配置模式;
验证码流位宽,被动配置模式下,根据空字判断码流位宽;主动配置模式下,自动略过空字验证;
验证初始帧同步字,在主动配置模式下,根据fls_sel赋值验证S-flash的传输模式;根据Cpr_en赋值验证压缩使能;在主动配置模式下,验证初始帧后面的比特流长度;
根据设置配置寄存器值字段的芯片ID验证器件ID;
旁路循环冗余校验;
验证加载第二配置数据;
启动完成加载第二配置链组结束信号。
5.如权利要求4所述一种FPGA中配置控制器验证方法,其特征在于,所述压缩使能利用由所述具有完整验证功能码流结构的全码流修改后生成的第二码流进行验证。
6.如权利要求1所述一种FPGA中配置控制器验证方法,其特征在于,所述第二验证包括:
根据所述采样模式脚的M赋值识别FPGA配置模式,M赋值为0时,为主动配置模式,M赋值为1时,为被动配置模式;
依次运行第一码流的空字字段、初始帧同步字字段、设置配置寄存器值字段、加载第一配置数据字段;
验证循环冗余校验使能后是否正确;
循环冗余校验使能后验证通过,启动完成加载第一配置链组结束信号。
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