[发明专利]FPGA重加载方法、FPGA卡式设备和主机在审
申请号: | 202010059981.2 | 申请日: | 2020-01-19 |
公开(公告)号: | CN111309521A | 公开(公告)日: | 2020-06-19 |
发明(设计)人: | 赵轩博;皮广辉;徐成;郑泽华 | 申请(专利权)人: | 深圳市恒扬数据股份有限公司 |
主分类号: | G06F11/14 | 分类号: | G06F11/14 |
代理公司: | 深圳中一联合知识产权代理有限公司 44414 | 代理人: | 郑浩旋 |
地址: | 518000 广东省深圳市南山区*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | fpga 加载 方法 卡式 设备 主机 | ||
1.一种FPGA重加载方法,其特征在于,该方法包括:
主机下发FPGA卡式设备重加载配置;
所述主机以预设时间间隔为周期,向所述FPGA卡式设备发送心跳消息;
所述FPGA卡式设备根据所述主机发送的心跳消息进行重加载。
2.根据权利要求1所述的FPGA重加载方法,其特征在于,所述主机以预设时间间隔为周期,向所述FPGA卡式设备发送心跳消息包括:
所述主机以所述预设时间间隔为周期,在所述FPGA卡式设备的第一寄存器进行写操作。
3.根据权利要求1所述的FPGA重加载方法,其特征在于,所述FPGA卡式设备根据所述主机发送的心跳消息进行重加载包括:
若所述FPGA卡式设备判断连续N个周期没有接收到所述主机发送的心跳消息,则所述FPGA卡式设备进行重加载,其中,N为预设值,且N为正整数。
4.根据权利要求1所述的FPGA重加载方法,其特征在于,在所述主机下发FPGA卡式设备重加载配置之后,该方法还包括:
所述主机在所述FPGA卡式设备的第二寄存器写入第一预设字符串;
所述主机根据所述第二寄存器的值,判断所述FPGA卡式设备是否重加载成功。
5.根据权利要求4所述的FPGA重加载方法,其特征在于,所述主机根据所述第二寄存器的值,判断所述FPGA卡式设备是否重加载成功包括:
若所述第二寄存器的值为第二预设字符串,则所述主机判断所述FPGA卡式设备重加载成功;
若所述第二寄存器的值为所述第一预设字符串,则所述主机判断所述FPGA卡式设备重加载失败,其中,所述第二预设字符串与所述第一预设字符串不相同。
6.根据权利要求1至5任一项所述的FPGA重加载方法,其特征在于,该方法还包括:
所述主机在卸载FPGA驱动之前,移除所述FPGA卡式设备和关闭PCIe桥上连端口;
所述主机卸载FPGA驱动并释放Bar空间。
7.一种FPGA卡式设备,其特征在于,用于:
接收主机以预设时间间隔为周期发送的心跳消息,并根据所述心跳消息进行重加载。
8.一种主机,其特征在于,用于:
下发FPGA卡式设备重加载配置;
以预设时间间隔为周期,向所述FPGA卡式设备发送心跳消息,以使得所述FPGA卡式设备根据所述主机发送的心跳消息进行重加载。
9.根据权利要求8所述的主机,其特征在于,所述主机还用于:
在所述FPGA卡式设备的第二寄存器写入第一预设字符串;
根据所述第二寄存器的值,判断所述FPGA卡式设备是否重加载成功。
10.根据权利要求8所述的主机,其特征在于,所述主机还用于:
在卸载FPGA驱动之前,移除所述FPGA卡式设备和关闭PCIe桥上连端口;
卸载FPGA驱动并释放Bar空间。
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