[发明专利]ZQ校准时间的缩减有效
申请号: | 201980058820.7 | 申请日: | 2019-07-09 |
公开(公告)号: | CN112673430B | 公开(公告)日: | 2022-06-07 |
发明(设计)人: | 佐藤康夫;何源 | 申请(专利权)人: | 美光科技公司 |
主分类号: | G11C29/50 | 分类号: | G11C29/50;G11C7/10;G11C11/4093 |
代理公司: | 北京律盟知识产权代理有限责任公司 11287 | 代理人: | 王龙 |
地址: | 美国爱*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | zq 校准 时间 缩减 | ||
1.一种存储器系统,其包括:
封装,其具有经配置以连接到外部校准装置的引脚;
第一存储器装置,其安置在所述封装中,其包含:
第一垫,其用于经由所述引脚选择性连接到所述外部校准装置,
内部校准装置,其具有可编程的第一阻抗,及
第二垫,其连接到所述内部校准装置;
第二存储器装置,其安置在所述封装中,所述第二存储器装置包含用于选择性连接到所述第一存储器装置的所述第二垫的第三垫;及
处理装置,其可操作地耦合到所述第一存储器装置及所述第二存储器装置,以:
基于所述外部校准装置对所述第一阻抗进行编程,及
基于所述第一阻抗对所述第二存储器装置中的端接组件的第二阻抗进行编程。
2.根据权利要求1所述的存储器系统,其进一步包括:
第三存储器装置,其安置在所述封装中,所述第三存储器装置包含用于经由所述引脚选择性连接到所述外部校准装置的第四垫,
其中所述处理装置经进一步配置以:
确定用于对所述第三存储器装置的第二端接组件的第三阻抗进行编程的第一校准代码信号,及
确定用于对所述第二阻抗进行编程的第二校准代码信号,及
其中并行地进行对所述第一校准代码信号的所述确定及对所述第二校准代码信号的所述确定。
3.根据权利要求1所述的存储器系统,其中对所述第一阻抗的所述编程包含:
使用所述外部校准装置确定用于所述第一存储器装置中的第二端接组件的第一校准代码信号,
使用所述第一校准代码信号确定用于所述第二端接组件的第二校准代码信号,及
使用所述第二校准代码信号对所述第一阻抗进行编程。
4.根据权利要求1所述的存储器系统,其中所述第二存储器装置为安置在所述封装中的多个第二存储器装置中的一个,及
其中所述多个第二存储器装置的每一相应第三垫经配置用于选择性连接到所述第一存储器装置的所述第二垫。
5.根据权利要求1所述的存储器系统,其中所述第一存储器装置为安置在所述封装中的多个第一存储器装置中的一个,且所述第二存储器装置为安置在所述封装中的多个第二存储器装置中的一个,
其中,对于所述多个第一存储器装置的每一第一存储器装置,所述多个第二存储器装置的部分经配置以经由相应第二存储器装置的所述第三垫选择性地连接到相应第一存储器装置的所述第二垫。
6.根据权利要求5所述的存储器系统,其中所述第一存储器装置中的每一个包含第一仲裁器电路,以确保不超过一个第一存储器装置连接到所述外部校准装置,且所述第二存储器装置中的每一个包含第二仲裁器电路,以确保不超过一个第二存储器装置连接到所述相应第一存储器装置的所述内部校准装置。
7.根据权利要求5所述的存储器系统,其中第一存储器装置的数目在1到6的范围内,且对于第二存储器装置的每一部分,第二存储器装置的数目高达4。
8.根据权利要求5所述的存储器系统,其中第一存储器装置的数目为4,且第二存储器装置的每一部分中的第二存储器装置的数目为3。
9.一种用于存储器系统的方法,其包括:
将第一存储器装置连接到与封装的引脚连接的外部校准装置;
基于所述外部校准装置对第一存储器装置的内部校准装置的第一阻抗进行编程,及
基于所述第一阻抗在第二存储器装置中的端接组件的第二阻抗进行编程。
10.根据权利要求9所述的方法,其进一步包括:
经由所述引脚将第三存储器装置连接到所述外部校准装置;
确定用于对所述第三存储器装置的端接组件的第三阻抗进行编程的第一校准代码信号;及
确定用于对所述第二阻抗进行编程的第二校准代码信号,
其中并行地进行对所述第一校准代码信号的所述确定及对所述第二校准代码信号的所述确定。
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