[发明专利]嵌入式通用串行总线2中继器在审
申请号: | 201980055643.7 | 申请日: | 2019-08-23 |
公开(公告)号: | CN112840293A | 公开(公告)日: | 2021-05-25 |
发明(设计)人: | W·N·貌;D·E·温特;M·U·厄尔多甘;黄焕章;S·葛亚尔;B·莎尔玛 | 申请(专利权)人: | 德克萨斯仪器股份有限公司 |
主分类号: | G06F3/00 | 分类号: | G06F3/00;G06F13/42 |
代理公司: | 北京纪凯知识产权代理有限公司 11245 | 代理人: | 袁策 |
地址: | 美国德*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 嵌入式 通用 串行 总线 中继 | ||
1.一种电路,其包括:
第一放大器,其具有耦合到第一节点的第一输入端、耦合到第二节点的第二输入端、第一输出端,以及第二输出端;
第二放大器,其具有耦合到所述第一放大器的所述第一输出端的第一输入端、耦合到所述第一放大器的所述第二输出端的第二输入端、第一输出端,以及第二输出端;
第三放大器,其具有耦合到所述第二放大器的所述第一输出端的第一输入端、耦合到所述第二放大器的所述第二输出端的第二输入端、控制输入端、耦合到第三节点的第一输出端,以及耦合到第四节点的第二输出端;
静噪检测器,其具有耦合到所述第一节点的第一输入端、耦合到所述第二节点的第二输入端,以及输出端;
第一电阻器,其耦合在所述第一节点和第五节点之间;
第二电阻器,其耦合在所述第五节点和所述第二节点之间;
比较器,其具有耦合到所述第五节点的第一输入端、耦合到第六节点的第二输入端,以及输出端;以及
逻辑电路,其具有耦合到所述静噪检测器的所述输出端的第一输入端、耦合到所述比较器的所述输出端的第二输入端,以及耦合到所述第三放大器的所述控制输入端的输出端。
2.根据权利要求1所述的电路,还包括:
第三电阻器,其耦合在所述第一节点和第七节点之间;
第四电阻器,其耦合在所述第七节点和所述第二节点之间;以及
电容器,其耦合在所述第七节点和接地端子之间。
3.根据权利要求1所述的电路,其中所述第一节点被配置为耦合到嵌入式通用串行总线USB系统即eUSB2系统的差分信号线的正端子,其中所述第二节点被配置为耦合到所述eUSB2系统的所述差分信号线的负端子,其中所述第三节点被配置为耦合到传统USB系统的差分信号线的正端子,并且其中所述第四节点被配置为耦合到所述传统USB系统的所述差分信号线的负端子。
4.根据权利要求1所述的电路,其中在所述第六节点处接收参考电压VREF,其中VREF的值大于高速差分通信的理想共模电压Vcm,并且小于指示单端信号的逻辑高值的值。
5.根据权利要求4所述的电路,其中所述比较器被配置为将在所述第五节点处存在的信号的值与VREF进行比较,以指示所述电路是否正在接收所述单端信号。
6.根据权利要求4所述的电路,其中接收具有上升沿转变的偏斜的单端信号对,其中所述静噪检测器将所述偏斜的单端信号对识别为高速差分通信,并且其中所述比较器通过确定所述第五节点处存在的所述信号的所述值超过VREF来证明所述静噪检测器有误。
7.根据权利要求4所述的电路,其中接收差分输入信号,其中所述静噪检测器将所述差分输入信号识别为高速差分通信,并且其中所述比较器通过确定在所述第五节点处存在的所述信号的所述值不大于VREF来验证所述静噪检测器。
8.一种电路,其包括:
静噪检测器,其具有耦合到第一节点的第一输入端、耦合到第二节点的第二输入端,以及输出端,其中所述第一节点被配置为用浮置中心抽头来接收差分输入信号的正分量,并且其中所述第二节点被配置为用所述浮置中心抽头接收所述差分输入信号的负分量;
第一电阻器,其耦合在所述第一节点和第三节点之间;
第二电阻器,其耦合在所述第三节点和所述第二节点之间;
第三电阻器,其耦合在所述第一节点和第四节点之间;
第四电阻器,其耦合在所述第四节点和所述第二节点之间;
第一电容器,其耦合在所述第四节点和接地端子之间;
比较器,其具有耦合到所述第三节点的第一输入端、耦合到第五节点的第二输入端,以及输出端;以及
逻辑电路,其具有耦合到所述静噪检测器的所述输出端的第一输入端、耦合到所述逻辑电路的所述输出端的第二输入端,以及输出端。
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