[发明专利]用于可配置空间加速器中的非结构化数据流的装置、方法和系统在审
| 申请号: | 201980006827.4 | 申请日: | 2019-03-01 |
| 公开(公告)号: | CN111512292A | 公开(公告)日: | 2020-08-07 |
| 发明(设计)人: | P.哈尔彭;K.E.小弗勒明;J.苏哈 | 申请(专利权)人: | 英特尔公司 |
| 主分类号: | G06F13/16 | 分类号: | G06F13/16;G06F12/0868;G11C7/10 |
| 代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 周学斌;陈岚 |
| 地址: | 美国加利*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 用于 配置 空间 加速器 中的 结构 数据流 装置 方法 系统 | ||
1.一种装置,包括:
处理元件的空间阵列中的第一处理元件;
处理元件的空间阵列中的第二处理元件;
高速缓存;
第一存储器接口电路,其耦合到第一处理元件和高速缓存,第一存储器接口电路向高速缓存发出存储器请求,所述存储器请求包括以下字段,所述字段将第二存储器接口电路标识为用于所述存储器请求的数据的接收器;以及
第二存储器接口电路,其耦合到第二处理元件和高速缓存,当用于存储器请求的数据到达第二存储器接口电路时,第二存储器接口电路向第一存储器接口电路发送信用返回值,以使第一存储器接口电路将存储器请求标记为完成,并且第二存储器接口电路的完成配置寄存器被设置为远程响应值。
2.根据权利要求1所述的装置,其中,当用于第二存储器请求的数据到达第二存储器接口电路时,第二存储器接口电路将在第二存储器接口电路内发送第二信用返回值,以使第二存储器接口电路将来自第二存储器接口电路的第二存储器请求标记为完成,并且第二存储器接口电路的完成配置寄存器被设置为本地响应值。
3.根据权利要求1所述的装置,其中,第一存储器接口电路包括:接收器完成流控制寄存器,其在被设置为第一值时使开关从与第二存储器接口电路耦合的输入中获取信用返回值,并且在被设置为时第二值时使开关从第一存储器接口电路获取信用返回值。
4.根据权利要求1所述的装置,其中,第一存储器接口电路将不会向高速缓存发出另一个存储器请求,直到所述存储器请求被标记为完成为止。
5.根据权利要求1所述的装置,其中,当第二处理元件读取了存储用于存储器请求的数据的第二存储器接口电路的完成缓冲器的时隙时,第二存储器接口电路将发送信用返回值。
6.根据权利要求1所述的装置,其中,存储器请求包括:第二字段,用以标识第二存储器接口电路的完成缓冲器的时隙,以存储用于存储器请求的数据。
7.根据权利要求6所述的装置,其中,存储器请求包括:第三字段,用以将第一存储器接口电路标识为用于存储器请求的请求者。
8.根据权利要求1-7中任一项所述的装置,其中,第二存储器接口电路将在处理元件的空间阵列的电路交换网络的通道上发送信用返回值。
9.一种方法,包括:
从耦合到处理元件的空间阵列中的第一处理元件和高速缓存的第一存储器接口电路向高速缓存发出存储器请求,所述存储器请求包括以下字段,所述字段将第二存储器接口电路标识为用于存储器请求的数据的接收器;
将第二存储器接口电路的完成配置寄存器设置为远程响应值;以及
当用于存储器请求的数据到达第二存储器接口电路时,将信用返回值从耦合到处理元件的空间阵列中的第二处理元件和高速缓存的第二存储器接口电路发送到第一存储器接口电路,以使第一存储器接口电路将存储器请求标记为完成,并且第二存储器接口电路的完成配置寄存器被设置为远程响应值。
10.根据权利要求9所述的方法,进一步包括:当用于第二存储器请求的数据到达第二存储器接口电路时,第二存储器接口电路在第二存储器接口电路内发送第二信用返回值,以使第二存储器接口电路将来自第二存储器接口电路的第二存储器请求标记为完成,并且第二存储器接口电路的完成配置寄存器被设置为本地响应值。
11.根据权利要求9所述的方法,进一步包括:
将第一存储器接口电路的接收器完成流控制寄存器设置为第一值,以使开关从与第二存储器接口电路耦合的输入中获取信用返回值;以及
将第一存储器接口电路的接收器完成流控制寄存器设置为第二值,以使开关从第一存储器接口电路获取信用返回值。
12.根据权利要求9所述的方法,进一步包括:第一存储器接口电路不会向高速缓存发出另一个存储器请求,直到所述存储器请求被标记为完成为止。
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