[实用新型]一种查表数字电路有效
| 申请号： | 201920353195.6 | 申请日： | 2019-03-20 |
| 公开（公告）号： | CN209525652U | 公开（公告）日： | 2019-10-22 |
| 发明（设计）人： | 武建峰;钱振煌;崔亚军 | 申请（专利权）人： | 泉州昆泰芯微电子科技有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 南京苏科专利代理有限责任公司 32102 | 代理人： | 姚姣阳 |
| 地址： | 362011 福建省泉州*** | 国省代码： | 福建;35 |
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| 摘要： | |||
| 搜索关键词： | 数字电路 查表 除法器 乘法器 寄存器 本实用新型 加法器 电路简化 电路结构 多重复用 分时复用 阶段运算 拟合曲线 设计优化 分阶段 二阶 复用 减小 暂存 运算 应用 分解 | ||
【权利要求书】：
1.一种查表数字电路，用于拉格朗日二阶插值拟合曲线，其特征在于：所述查表数字电路由一个除法器、两个乘法器、一个加法器和寄存器构成，所述除法器的输出端与其一乘法器之间通过一个寄存器相接，且其一乘法器的输出接入另一乘法器的输入端，另一乘法器的另一输入端接入对应已知坐标点的y值，且所述另一乘法器的输出端通过寄存器接入加法器，由此互联相接成一体，且整个电路各组成部分按时序分时复用进行插值运算。
2.根据权利要求1所述查表数字电路，其特征在于：已知三点的坐标为（t1，y1）、（t2，y2）、（t3，y3），所拟合的曲线L（t）参照拉格朗日二阶插值公式为：
，
且公式中除法运算部分的格式相共性。
3.根据权利要求1所述查表数字电路，其特征在于：所述查表数字电路中除法器具有x0、x1、x三个输入端、具有DIV一个输出端，且除法器的运算公式为：。
4.根据权利要求1所述查表数字电路，其特征在于：所述查表数字电路配置有对应除法器输出的第一层级寄存器。
5.根据权利要求1所述查表数字电路，其特征在于：所述查表数字电路配置有对应成串乘法器输出的第二层级寄存器。
6.根据权利要求1所述查表数字电路，其特征在于：所述查表数字电路配置有对应加法器输出的第三层级寄存器。
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