[发明专利]一种智能网卡及其通讯方法在审

专利信息
申请号: 201911208734.8 申请日: 2019-11-30
公开(公告)号: CN111107061A 公开(公告)日: 2020-05-05
发明(设计)人: 徐亚明;刘伟;仝培霖 申请(专利权)人: 浪潮(北京)电子信息产业有限公司
主分类号: H04L29/06 分类号: H04L29/06;H04L29/08;G06F8/65;H04L12/26
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 高勇
地址: 100085 北京市海*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 智能 网卡 及其 通讯 方法
【说明书】:

本申请提供一种智能网卡,包括CPU和FPGA,包括:所述智能网卡包含两个数据光口,每个所述数据光口与数据分离模块相连,所述数据分离模块与FPGA中的IP核相连;所述CPU与所述FPGA以内部总线直连;所述CPU同时搭载嵌入式linux系统和freeRTOS系统。本申请通过使用异构多核架构的芯片,使得智能网卡在功能、功耗、灵活性以及可扩展性达到最佳平衡。本申请还提供一种智能网卡的通讯方法,具有上述有益效果。

技术领域

本申请涉及通信设备领域,特别涉及一种智能网卡及其通讯方法。

背景技术

目前常用智能网卡方案包括多CPU芯片和FPGA+软核等。若采用多CPU芯片,则网卡功耗过大,性能受到当前芯片的限制,不利于扩展。采用FPGA+软核,不能胜任复杂的业务逻辑控制。因此如何提高智能网卡的应用性是本领域技术人员亟需解决的技术问题。

发明内容

本申请的目的是提供一种智能网卡及其通讯方法,能够提高智能网卡的应用性能。

为解决上述技术问题,本申请提供一种智能网卡,包括CPU和FPGA,具体技术方案如下:

所述智能网卡包含两个数据光口,每个所述数据光口与数据分离模块相连,所述数据分离模块与FPGA中的IP核相连;

所述CPU与所述FPGA以内部总线直连;

所述CPU同时搭载嵌入式linux系统和freeRTOS系统。

其中,所述CPU包括Cortex-A53和Cortex-R5,所述嵌入式linux系统运行于所述Cortex-A53上,所述freeRTOS系统运行与所述Cortex-R5上。

其中,所述IP核为mcdma。

其中,所述内部总线为AXI总线。

本申请还提供一种智能网卡的通讯方法,基于上文所述的智能网卡,包括:

通过数据光口接收数据报文;

利用数据分离模块将所述数据报文分为控制面流量和数据面流量;

将所述控制面流量发送至嵌入式linux系统,以使所述嵌入式linux系统将IP核识别为网卡,以便进行通信。

其中,还包括:

利用freeRTOS系统通过IIC接口获取BMC状态信息;

将所述BMC状态信息上传至所述嵌入式linux系统。

其中,还包括:

利用ACL规则过滤模块过滤所述数据面流量中的无效网络数据。

其中,利用ACL规则过滤模块过滤所述数据面流量中的无效网络数据之后,还包括:

根据所述数据面流量中的数据标签对特定应用加速。

其中,还包括:

利用freeRTOS系统采集所述智能网卡的网络流量信息,并对所述网络流量信息进行监控。

其中,还包括:

所述嵌入式linux系统通过IP核从远程数据中心获取程序版本信息。

本申请还提供一种计算机可读存储介质,其上存储有计算机程序,所述计算机程序被处理器执行时实现如上所述的方法的步骤。

本申请还提供一种终端,包括存储器和处理器,所述存储器中存有计算机程序,所述处理器调用所述存储器中的计算机程序时实现如上所述的方法的步骤。

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