[发明专利]聚合性组合物、墨水、转印母模及电极构件的形成方法在审
申请号: | 201911125594.8 | 申请日: | 2019-11-15 |
公开(公告)号: | CN111320721A | 公开(公告)日: | 2020-06-23 |
发明(设计)人: | 古田智嗣;杉原克幸 | 申请(专利权)人: | 捷恩智株式会社 |
主分类号: | C08F220/58 | 分类号: | C08F220/58;C08F226/06;C08F220/56;C08F220/18;C08F222/20;C09D11/30;H01B5/14;H01B13/00 |
代理公司: | 北京同立钧成知识产权代理有限公司 11205 | 代理人: | 罗英;臧建明 |
地址: | 日本东京千代田区大手町二丁*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 聚合 组合 墨水 转印母模 电极 构件 形成 方法 | ||
本发明提供一种即便经过高温环境也可适当地保持硬化后的形状,并且能够利用含水溶解液而溶解的电离放射线硬化型的聚合性组合物、墨水、转印母模及电极构件的形成方法。聚合性组合物,用以形成转印母模,且所述聚合性组合物含有:含乙烯基的成分;以及聚合引发剂;其中所述含乙烯基的成分含有:(甲基)丙烯酰基吗啉、乙烯基内酰胺化合物、第1成分,包含由下述化学式(1)所示的化合物、及第2成分,包含由下述化学式(2)所示的化合物,且所述聚合引发剂通过电离放射线的照射而产生自由基。此处,R0为氢或甲基,R1及R2分别独立地为氢或碳数3以下的烷基,R3及R4分别独立地为氢或甲基,n及m独立地为0~12的整数,且n+m为12以下。[化1][化2]
技术领域
本发明涉及一种当与高密度化安装对应地成批进行电极形成时可优选地使用的聚合性组合物、包含所述聚合性组合物的墨水、包含对所述聚合性组合物照射电离放射线而获得的电离放射线硬化物的转印母模、及包括使用所述聚合性组合物而形成于基材上的电极群的电极构件的制造方法。
背景技术
在专利文献1中,关于在作为高密度化安装的一形态的晶片级芯片尺寸封装(wafer level chip size packaging,WL-CSP)中,在晶片上所形成的多个半导体装置(集成电路(integrated circuit,IC))中成批地形成电极的技术,记载了一种具有包含非感放射线性树脂组合物的下层与包含负型感放射线性树脂组合物的上层且能够兼顾高分辨率性与易剥离性的双层层叠膜、及使用所述双层层叠膜形成凸块的方法。
[现有技术文献]
[专利文献]
[专利文献1]日本专利特开2007-79550公报
发明内容
[发明所要解决的问题]
在专利文献1所记载的所述双层层叠膜中,当显影时上层中仅残存经放射线照射的部分,下层中对应于上层中的去除部分(放射线非照射部)的部分被溶解去除。因此,双层层叠膜中仅残存经放射线照射的部分,双层层叠膜中的放射线非照射部在显影阶段被去除。在如此双层层叠膜进行了去除后的部分中埋入金属膏,并连同晶片一起进行加热而使金属膏回流,从而在晶片上成批形成多个凸块。在如此进行凸块的成批形成后,利用二甲基亚砜(dimethyl sulfoxide,DMSO)之类的有机溶剂系剥离液将晶片上残存的双层层叠膜去除。
近年来,安装密度不断提高,因此为了形成凸块而形成于晶片上的负图案(转印母模)的形状复杂化(包括三维化)。然而,若欲通过使用如上所述的双层层叠膜而形成负图案的工艺来形成复杂形状的负图案,则步骤变得繁琐。因此,期待制造步骤的简化。另外,要求将晶片上残存的构成负图案的材料在凸块形成后切实地去除,但因对环境问题的关注提高,故寻求一种并非利用如上所述的有机溶剂系剥离液,而能够利用水系剥离液予以去除的材料。
进而,在最近的高密度安装技术中,采用在超过芯片面积的广大区域形成再配线层的扇出(fan-out)型晶片级封装(wafer level packaging,WLP),也实现了将所述扇出型WLP层叠多层的堆叠模块(stack module)。在此种扇出型WLP中,在再配线层大量形成包含铜等的导电性柱,并在导电性柱上配置焊料球等连接材料。所述连接材料的配置精度随安装密度的提升而变高,因此要求将连接材料更准确地配置于导电性柱上。
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