[发明专利]采集模块整合输入系统在审

专利信息
申请号: 201911121314.6 申请日: 2019-11-15
公开(公告)号: CN110837337A 公开(公告)日: 2020-02-25
发明(设计)人: 潘文明 申请(专利权)人: 广州健飞通信有限公司
主分类号: G06F3/05 分类号: G06F3/05
代理公司: 北京联瑞联丰知识产权代理事务所(普通合伙) 11411 代理人: 张莹
地址: 511458 广东省广州市南沙区*** 国省代码: 广东;44
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摘要:
搜索关键词: 采集 模块 整合 输入 系统
【说明书】:

发明公开了一种采集模块整合输入系统,所述的采集模块整合输入系统,包括:模数转换模块、采集模块、用户数据报协议模块和千兆网口模块,用户可选3线式或4线式串行端口接口允许对许多内部参数进行编程和回读,且其中模数转换模块采用其采集模块,使数据直接通过其采集模块传输,让系统设计更加灵活。

技术领域

本发明涉及转换器的协议标准领域,特别涉及一种采集模块整合输入系统。

背景技术

过去大多数的模数转换器(Analog To Digital Converter, 下称ADC)不会配置高速的串行接口,即现场可编程门阵列(Field Programmable Gate Array, 下称FPGA)和转换器并没有凭借任何通用的标准接口,获得高速串行/解串行器带宽的优势。大多数的讯号处理系统,首要的定义系统是以模拟或射频频率、动态范围和取样率来建立转换器的选择标准。转换器是指将一种信号转换成另一种信号的装置。在自动化仪表设备和自动控制系统中,常将一种信号转换成另一种与标准量或参考虑比较后的信号,以便将两类仪表联接起来,因此转换器常常是两个仪表(或装置)间的中间环节。

为了减少FPGA上的计算负担,有些转换器供货商正在增加数字处理能力,作为转换器完整解决方案的一部分。有些讯号处理系统只须要使用一个讯号带宽的滤波部分,传送和处理到FPGA的全带宽数据或从FPGA来的全带宽资料是唯一且没有必要的负担。在以往的用户数据报协议模块中,帧时钟是系统的绝对时间参照,帧时钟和转换器采样时钟通常是相同的,这样就没有足够的灵活性,而且当要将此同样的信号路由给多个设备并计数不同路由路径之间的偏斜时,就会对系统设计产生不必要的复杂性。

发明内容

本发明要解决的技术问题在于,针对现有技术的上述缺陷,提供一种先进的低杂散与失真设计技术,从基带到高中频的宽带信号可以实现高质量合成的采集模块整合输入系统。

本发明解决其技术问题所采用的技术方案是:构造一种采集模块整合输入系统,包括:模数转换模块,包括采集模块,接收第一数据的模拟量转换为数字量,生成所述第一数据的数字量,并通过所述采集模块输出所述第一数据的数字量;用户数据报协议模块,电性连接所述模数转换模块,接收所述第一数据的数字量进行打包或解包处理;以及千兆网口模块,接收所述第一数据的数字量,并输出。

在本发明所述的系统中,所述模数转换模块为AD7961模数转换器。

在本发明所述的系统中,所述系统更进一步包括:人机接口,接收所述第一数据的数字量,并显示所述第一数据的数字量的波形。

在本发明所述的系统中,所述人机接口为显示器或个人计算机。

实施本发明的采集模块整合输入系统,具有以下有益效果:用户可选3线式或4线式串行端口接口允许对许多内部参数进行编程和回读,且其中模数转换模块采用其采集模块,使该数据直接通过其采集模块传输,让系统设计更加灵活。

附图说明

为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。

图1为本发明采集模块整合输入系统的结构示意图。

具体实施方式

下面将结合本发明实施例中的附图,对本发明实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本发明一部分实施例,而不是全部的实施例。基于本发明中的实施例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例,都属于本发明保护的范围。

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