[发明专利]一种用数字电路实现的插值滤波器系统有效
| 申请号: | 201910925674.5 | 申请日: | 2019-09-27 |
| 公开(公告)号: | CN110492867B | 公开(公告)日: | 2020-06-05 |
| 发明(设计)人: | 王莉莉 | 申请(专利权)人: | 珠海市一微半导体有限公司 |
| 主分类号: | H03H17/02 | 分类号: | H03H17/02 |
| 代理公司: | 暂无信息 | 代理人: | 暂无信息 |
| 地址: | 519000 广东省珠海*** | 国省代码: | 广东;44 |
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| 摘要: | |||
| 搜索关键词: | 一种 数字电路 实现 滤波器 系统 | ||
1.一种用数字电路实现的插值滤波器系统,其特征在于,该插值滤波器系统包括插值过滤运算控制器、级联驱动模块、中间结果缓存RAM和滤波系数存储ROM,插值过滤运算控制器包括级联的滤波器运算模块和一个主状态机,所述插值过滤运算控制器包括n个级联的滤波器运算模块和对应的子状态机,分别等效于相应级联的半带滤波器,所述主状态机包括n个子状态机,n为大于或等于1的整数;其中:
中间结果缓存RAM,用于存储插值滤波器系统的外部输入的数据和插值过滤运算控制器内部包括的各级滤波器运算模块计算输出的中间结果;
滤波系数存储ROM,用于存储插值过滤运算控制器内部包括的各级滤波器运算模块计算所需的滤波系数;
级联驱动模块包括用于控制插值过滤运算控制器读写中间结果缓存RAM和滤波系数存储ROM的一个计数器;
插值过滤运算控制器,用于在级联驱动模块输出的计数节拍的驱动下,控制主状态机选择中间结果缓存RAM或外部直接输入的数据送入级联的滤波器运算模块进行累加操作,同时也控制主状态机选择滤波系数存储ROM的滤波器系数送入级联的滤波器运算模块进行乘法操作,经过级联的滤波器运算模块处理后得到插值滤波的目的。
2.根据权利要求1所述插值滤波器系统,其特征在于,每一级的半带滤波器的输出结果都划分为奇数下标输出和偶数下标输出,是依据每一级的半带滤波器在所述级联驱动模块输出的计数节拍驱动下先后输出的,其中,偶数下标先从0开始,而奇数下标从1开始,按照先后输出的顺序由小到大进行标记;其中,在所述级联驱动模块驱动配合主状态机完成以下功能:
第一步,完成当前一级半带滤波器的工作,将需要保存的偶数下标的数据存放在所述中间结果缓存RAM相应的地址单元中,将需要保存的奇数下标输出的数据存放在当前一级半带滤波器内部相应的寄存器中;
第二步,将当前一级半带滤波器的所有输出结果直接地或通过内部相应寄存器间接地输出至下一级半带滤波器中,然后,将下一级半带滤波器需要保存的偶数下标输出的数据存放在所述中间结果缓存RAM相应的地址单元中,将需要保存的奇数下标输出的数据存放在下一级半带滤波器内部相应的寄存器中;
重复迭代第一步和第二步实现串行运算,直到第n级半带滤波器先后运算得到的2的n次幂个结果直接地或通过内部相应寄存器间接地输出至所述中间结果缓存RAM相应的地址单元中,作为所述插值过滤运算控制器的插值结果。
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