[发明专利]防止乱序机器中归因于误推测的信息泄露在审

专利信息
申请号: 201910691268.7 申请日: 2019-07-29
公开(公告)号: CN110781499A 公开(公告)日: 2020-02-11
发明(设计)人: D·A·卡尔森;S·S·穆克吉 申请(专利权)人: 马维尔国际贸易有限公司
主分类号: G06F21/57 分类号: G06F21/57;G06F21/55
代理公司: 11256 北京市金杜律师事务所 代理人: 酆迅;张曦
地址: 巴巴多斯*** 国省代码: 巴巴多斯;BB
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摘要:
搜索关键词: 高速缓存 乱序 重排序缓冲器 安全漏洞 存储数据 数据泄露 信息存储 信息泄露 指令 响应 检测 移动 访问
【权利要求书】:

1.一种方法,包括:

将与乱序机器的第一状态有关的信息存储至重排序缓冲器,所述信息指示至少一个寄存器的状态;

将与所述乱序机器的第二状态有关的信息存储至所述重排序缓冲器,所述信息指示数据是否在从所述第一状态到所述第二状态的转变期间被移动至高速缓存;以及

响应于检测到所述第二状态的误推测事件,防止对存储所述数据的所述高速缓存的至少一部分的访问。

2.根据权利要求1所述的方法,其中防止访问包括:使存储所述数据的所述高速缓存的所述至少一部分无效。

3.根据权利要求1所述的方法,其中防止访问包括:使所述高速缓存的全部无效。

4.根据权利要求1所述的方法,其中所述高速缓存包括d-高速缓存。

5.根据权利要求1所述的方法,其中所述高速缓存包括以下至少一项:分支目标高速缓存、分支目标缓冲器、存储-加载依赖性预测器、指令高速缓存、转换缓冲器、第二级高速缓存、末级高速缓存、以及DRAM高速缓存。

6.根据权利要求1所述的方法,进一步包括:响应于检测到所述误推测事件,使以下至少一项无效:分支预测器、分支目标高速缓存、分支目标缓冲器、存储-加载依赖性预测器、指令高速缓存、转换缓冲器、第二级高速缓存、末级高速缓存、以及DRAM高速缓存。

7.根据权利要求1所述的方法,其中与所述第二状态有关的所述信息包括:存储所述数据的高速缓存块的位置的指示。

8.根据权利要求1所述的方法,其中与所述第二状态有关的所述信息包括:在与所述误推测事件相关联的一个或多个操作的执行期间创建的高速缓存块的指示。

9.根据权利要求1所述的方法,进一步包括:基于与所述第二状态有关的所述信息,标识在与所述误推测事件相关联的操作的执行期间创建的高速缓存块。

10.根据权利要求1所述的方法,其中所述误推测事件发生在由所述机器执行的加载/存储操作期间。

11.根据权利要求10所述的方法,其中所述第一状态对应于在所述加载/存储操作的执行之前的所述机器的状态,并且其中所述第二状态对应于在所述加载/存储操作的所述执行之后的所述机器的状态。

12.一种乱序机器,包括:

高速缓存;

处理器,被配置为执行指令;

重排序缓冲器;以及

控制器,被配置为:

在所述指令的执行之前,将与所述乱序机器的第一状态有关的信息存储至所述重排序缓冲器;

在所述指令的执行之后,将与所述乱序机器的第二状态有关的信息存储至所述重排序缓冲器,所述信息指示数据是否在所述第一状态和所述第二状态之间被移动至所述高速缓存;以及

响应于检测到所述第二状态的误推测事件,防止对存储所述数据的所述高速缓存的至少一部分的访问。

13.根据权利要求12所述的机器,其中所述控制器进一步被配置为:通过使存储所述数据的所述高速缓存的所述至少一部分无效,来防止访问。

14.根据权利要求12所述的机器,其中所述控制器进一步被配置为:通过使所述高速缓存的全部无效来防止访问。

15.根据权利要求12所述的机器,其中所述高速缓存包括d-高速缓存。

16.根据权利要求12所述的机器,其中所述高速缓存包括以下至少一项:分支目标高速缓存、分支目标缓冲器、存储-加载依赖性预测器、指令高速缓存、转换缓冲器、第二级高速缓存、末级高速缓存、以及DRAM高速缓存。

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