[发明专利]一种用于数据加解密传输的数据板在审
申请号: | 201910621786.1 | 申请日: | 2019-07-10 |
公开(公告)号: | CN110334534A | 公开(公告)日: | 2019-10-15 |
发明(设计)人: | 高俊;王滨华;张斌 | 申请(专利权)人: | 高俊 |
主分类号: | G06F21/60 | 分类号: | G06F21/60;G06F21/62;G06F11/32;G06F11/14 |
代理公司: | 昆明合众智信知识产权事务所 53113 | 代理人: | 张玺 |
地址: | 213000 江*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 数据加解密 电源模块 乌龟 按键 指示灯 微处理器监控器 看门狗定时器 千兆网络芯片 数据传输过程 安全存储器 升压转换器 网络变压器 传输 集成芯片 闪存芯片 外接接口 转换芯片 数据板 稳压器 解密 晶振 网口 与门 自带 加密 芯片 终端 供电 输出 保证 | ||
1.一种用于数据加解密传输的数据板,其特征在于,它包括:
电源模块(1),输出四种电压VCC、VDD、VKK和VDDS_DDR为不同芯片供电;
DC-DC升压转换器(2),分别与USB芯片(3)和安全存储器(4)相连,用于输出固定直流电压给USB芯片(3)和安全存储器(4)供电;
安全存储器(4)和闪存芯片(5),均与集成芯片(6)相连,安全存储器(4)通过协议识别认证给闪存芯片(5)解密,集成芯片(6)读取闪存芯片(5)后获得程序开始运行;
第一Micro SD卡座(7)和第二Micro SD卡座(8),均与集成芯片(6)相连,插入密钥卡,用于存储数据传输过程中的加密解密的密钥;
N型MOS管(9),分别与集成芯片(6)和指示灯外接接口(10)相连,用于控制数据板工作指示灯常亮或闪烁;
第一晶振(11)和第二晶振(12),分别与第一PHY千兆网络芯片(13)和第二PHY千兆网络芯片(14)相连,分别产生时钟序列给第一PHY千兆网络芯片(13)以及USB芯片(3)和第二PHY千兆网络芯片(14)以及USB芯片(3),使这些芯片按照一定周期运作;
带看门狗定时器的微处理器监控器(15),与集成芯片(6)连成一个回路,同时分别与第一PHY千兆网络芯片(13)和第二PHY千兆网络芯片(14)相连,第一PHY千兆网络芯片(13)和第二PHY千兆网络芯片(14)之间通过一个与门(16)与集成芯片(6)相连,用于定时接收信号监控电路信号,一旦发生错误,则向集成芯片(6)、第一PHY千兆网络芯片(13)和第二PHY千兆网络芯片(14)发出重启信号,第一PHY千兆网络芯片(13)和第二PHY千兆网络芯片(14)输出的系统中断信号经过与门(16)传输给集成芯片(6),及时中断并重启系统;
第一PHY千兆网络芯片(13)和第二PHY千兆网络芯片(14),分别与第一网络变压器(17)以及第一网口(18)和第二网络变压器(19)以及第二网口(20)依次相连,第一网口(18)接收一台设备的网板传输的数据包,并传输至第一网络变压器(17)进行除噪后,传输到第一PHY千兆网络芯片(13)进行模数转换得到数字信号,再经译码器译码后从RGMII接口传入集成芯片(6),集成芯片(6)对数据包进行解密,再从RGMII接口传输给第二PHY千兆网络芯片(14),经编码器编码后进行数模转换得到模拟信号,再经过第二网络变压器(19)除噪,从第二网口(20)输出,第二网口(20)连接主板,反之的过程亦相同;
自带ESD保护的RS-232转换芯片(21),与集成芯片(6)相连,用于将信号转换成串行信号;
DDR终端稳压器(22),分别与集成芯片(6)和DDR3内存条(23)相连,用于产生一个线性稳压给DDR3内存条(23)供电,并提供参考电压给DDR3内存条(23)和集成芯片(6);
DDR3内存条(23),与集成芯片(6)相连,作为集成芯片(6)的临时存储,用于暂时存放集成芯片(6)的运算数据,在运行过程中,集成芯片(6)先将数据调入内存中运算,完成后再将结果传输出来。
2.根据权利要求1所述的用于数据加解密传输的数据板,其特征在于,它还包括:
SW1中乌龟按键(24)和SW2中乌龟按键(25),均与集成芯片(6)相连,用于数据板测试人员进行系统重置。
3.根据权利要求1所述的用于数据加解密传输的数据板,其特征在于,所述电源模块(1)包括电源(101)、第一降压电路(102)、第一电压比较器(103)、第二降压电路(104)、第二电压比较器(105)、第三降压电路(106)和第四降压电路(107),电源(101)输入电压VEE至第一降压电路(102),经第一降压电路(102)后输出电压VKK或输入至第一电压比较器(103),经第一电压比较器(103)后输入至第二降压电路(104),经第二降压电路(104)后输出电压VDD或输入至第二电压比较器(105),经第二电压比较器(105)后分别输入至第三降压电路(106)和第四降压电路(107),经第三降压电路(106)后输出电压VCC,经第四降压电路(107)后输出电压VDDS_DDR。
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