[发明专利]一种多路电源电压快速放电电路在审
申请号: | 201910586737.9 | 申请日: | 2019-07-01 |
公开(公告)号: | CN112187028A | 公开(公告)日: | 2021-01-05 |
发明(设计)人: | 梅志焕 | 申请(专利权)人: | 广州慧睿思通信息科技有限公司 |
主分类号: | H02M1/32 | 分类号: | H02M1/32 |
代理公司: | 深圳智汇远见知识产权代理有限公司 44481 | 代理人: | 田俊峰 |
地址: | 510000 广东省*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 电源 电压 快速 放电 电路 | ||
本发明涉及一种多路电源电压快速放电电路,包括:控制电路、开关电路和第一放电电路,控制电路的第一端与电源管理芯片连接,第二端与第一放电电路的第一端连接,电源管理芯片输出电平信号控制所述控制电路的导通,控制电路输出控制信号给第一放电电路;开关电路的第一端与电源管理芯片连接,电源管理芯片输出电平信号控制开关电路的开闭;第一放电电路的第二端与开关电路的第二端连接,当所述开关电路导通时,第一放电电路通过开关电路进行放电;所述第一放电电路包括多条电源电路。本发明提供的技术方案将所有的电源电路都通过一个开关电路进行放电,使得电子元件的数量大大减少,因此节省占用电路板的空间,使产品小型化。
技术领域
本发明涉及一种保护电路,尤其涉及一种多路电源电压快速放电电路。
背景技术
Arria 10 FPGA在掉电时,放电电路通过电源管理芯片分别控制各组FPGA的电源轨依次掉电,同时分别依次控制mos管导通,在经过大功率电阻进行快速放电。
在FPGA放电时,每个电源轨都需要一组mos管和大功率电阻进行放电,而且大功率电阻的体积相对较大,从而多个大功率电阻会占用PCB(Printed Circuit Board,印制电路板)的很大空间,导致芯片的体积较大。
因此,需要提供一种多路电源电压快速放电电路来解决现有技术的不足。
发明内容
为了解决现有技术中的问题,本发明提供了一种多路电源电压快速放电电路,通过优化电路的结构,减少电子元件,从而节省占用电路板的空间,使得产品小型化。
本发明提供了一种多路电源电压快速放电电路,包括:控制电路、开关电路和第一放电电路,
所述控制电路的第一端与电源管理芯片连接,第二端与所述第一放电电路的第一端连接,所述电源管理芯片输出电平信号控制所述控制电路的导通,所述控制电路输出控制信号给所述第一放电电路;
所述开关电路的第一端与所述电源管理芯片连接,所述电源管理芯片输出电平信号控制所述开关电路的开闭;
所述第一放电电路的第二端与所述开关电路的第二端连接,当所述开关电路导通时,第一放电电路通过所述开关电路进行放电;所述第一放电电路包括多条电源电路。
进一步地,所述控制电路包括:第一控制电路和第二控制电路,
所述第一控制电路的输入端与所述电源管理芯片连接,输出端与所述电路板的复位输入端连接;
所述第二控制电路的输入端与所述电源管理芯片连接,输出端与所述第一放电电路的第一端连接。
进一步地,所述第一控制电路包括:第一开关器件,
所述第一开关器件的第一端与所述电源管理芯片连接,第二端与所述电路板的复位输出端连接,第三端接地;
所述第一开关器件,用于将所述电源管理芯片输出的信号进行反相,通过反相信号控制所述电路板的复位输入端。
进一步地,所述第二控制电路包括多条并联连接的子控制电路;
所述第二控制电路的子控制电路的条数与所述第一放电电路的电源电路的条数相等。
进一步地,所述第二控制电路的任意一条子控制电路均包括:第二开关器件,
所述第二开关器件的第一端与所述电源管理芯片连接,第二端与所述第一放电电路的第一端连接,第三端接地;
所述第二开关器件,用于将所述电源管理芯片输出的信号进行反相,通过反相信号控制所述第一放电电路。
进一步地,所述开关电路包括:第三开关器件和第一电阻,
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