[发明专利]用于制造半导体器件的图案形成方法和材料有效
| 申请号: | 201910568264.X | 申请日: | 2019-06-27 |
| 公开(公告)号: | CN110648904B | 公开(公告)日: | 2023-03-14 |
| 发明(设计)人: | 王建惟;张庆裕;张尚文;陈彦豪 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
| 主分类号: | H01L21/027 | 分类号: | H01L21/027 |
| 代理公司: | 北京东方亿思知识产权代理有限责任公司 11258 | 代理人: | 桑敏 |
| 地址: | 中国台*** | 国省代码: | 台湾;71 |
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| 摘要: | |||
| 搜索关键词: | 用于 制造 半导体器件 图案 形成 方法 材料 | ||
本公开涉及用于制造半导体器件的图案形成方法和材料。在图案形成方法中,在下层上方形成底层。在底层上方形成中间层。在中间层上方形成抗蚀剂图案。通过使用抗蚀剂图案作为蚀刻掩模对中间层进行图案化。通过使用经图案化的中间层对底层进行图案化。对下层进行图案化。中间层包含50wt%或更多的硅和有机材料。在前述和后述实施例中的一个或多个中,在形成中间层之后进一步实施退火操作。
技术领域
本公开涉及用于制造半导体器件的图案形成方法和材料。
背景技术
随着半导体行业已经发展到纳米技术工艺节点,以追求更高的器件密度、更高的性能和更低的成本,来自制造和设计问题的挑战变得更大。用于形成图案的光刻操作是半导体制造工艺中的关键操作之一。
发明内容
根据本公开的一个实施例,提供了一种图案形成方法,包括:在下层上方形成底层;在所述底层上方形成中间层;在所述中间层上方形成抗蚀剂图案;通过使用所述抗蚀剂图案作为蚀刻掩模对所述中间层进行图案化;通过使用经图案化的中间层对所述底层进行图案化;以及对所述下层进行图案化,其中,所述中间层包含硅和有机材料,所述硅的量为50wt%或更多。
根据本公开的另一实施例,提供了一种图案形成方法,包括:在下层上方形成含Si层;在所述含Si层上方形成抗蚀剂图案;通过使用所述抗蚀剂图案作为蚀刻掩模对所述含Si层进行图案化;以及通过使用经图案化的含Si层对所述下层进行图案化;其中,所述含Si层包含50wt%或更多量的硅、或者包含70wt%或更少量的硅,并且不是非晶硅层、多晶硅层、基于氧化硅的层或基于氮化硅的层。
根据本公开的又一实施例,提供了一种用于制造半导体器件的含硅溶液,所述含硅溶液包括:硅颗粒或硅簇;以及溶剂,其中:所述硅颗粒或所述硅簇包括50wt%或更多量的硅、或者包括80wt%或更少量的硅,并且所述硅颗粒或所述硅簇中的每一个包括被多个有机配体包围的硅芯。
附图说明
在结合附图阅读下面的具体实施方式时,可以从下面的具体实施方式中最佳地理解本公开。应当注意,根据行业的标准做法,各种部件不是按比例绘制的,并且仅用于说明的目的。事实上,为了讨论的清楚起见,各种部件的尺寸可能被任意增大或减小。
图1示出了根据本公开的实施例的半导体器件的制造操作的各个阶段之一。
图2示出了根据本公开的实施例的半导体器件的制造操作的各个阶段之一。
图3示出了根据本公开的实施例的半导体器件的制造操作的各个阶段之一。
图4示出了根据本公开的实施例的半导体器件的制造操作的各个阶段之一。
图5示出了根据本公开的实施例的半导体器件的制造操作的各个阶段之一。
图6示出了根据本公开的实施例的半导体器件的制造操作的各个阶段之一。
图7示出了硅颗粒或硅簇的示意图。
图8示出了根据本公开的另一实施例的半导体器件的制造操作的各个阶段之一。
图9示出了根据本公开的另一实施例的半导体器件的制造操作的各个阶段之一。
图10示出了根据本公开的另一实施例的半导体器件的制造操作的各个阶段之一。
图11示出了根据本公开的另一实施例的半导体器件的制造操作的各个阶段之一。
图12示出了根据本公开的另一实施例的半导体器件的制造操作的各个阶段之一。
图13示出了根据本公开的另一实施例的半导体器件的制造操作的各个阶段之一。
图14示出了根据本公开的另一实施例的半导体器件的制造操作的各个阶段之一。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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