[发明专利]沟槽隔离结构的形成方法、化学气相沉积工艺在审
| 申请号: | 201910383100.X | 申请日: | 2019-05-09 |
| 公开(公告)号: | CN110137132A | 公开(公告)日: | 2019-08-16 |
| 发明(设计)人: | 李众;鲁旭斋;张锋;林宗贤 | 申请(专利权)人: | 德淮半导体有限公司 |
| 主分类号: | H01L21/762 | 分类号: | H01L21/762 |
| 代理公司: | 上海领洋专利代理事务所(普通合伙) 31292 | 代理人: | 吴靖靓 |
| 地址: | 223300 江苏*** | 国省代码: | 江苏;32 |
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| 摘要: | |||
| 搜索关键词: | 衬底 研磨停止层 半导体 沟槽隔离结构 氧化硅层 化学气相沉积 反应物组合 紫外光 羟基 热化学气相沉积 填充氧化硅 氧化硅薄膜 沟槽侧壁 液态物质 均匀性 氧化硅 致密性 沉积 刻蚀 填满 覆盖 优化 | ||
本发明技术方案公开了一种沟槽隔离结构的形成方法、化学气相沉积工艺。沟槽隔离结构的形成方法包括:提供半导体衬底,半导体衬底上形成有研磨停止层;依次刻蚀研磨停止层和半导体衬底,在研磨停止层和半导体衬底内形成沟槽;在半导体衬底内的沟槽侧壁及底部形成氧化硅层;采用紫外光以及含羟基的气态或液态物质对氧化硅层进行表面处理,或者,采用紫外光以及反应物组合对氧化硅层进行表面处理,所述反应物组合适于反应生成含羟基的物质;采用TEOS‑Ozone热化学气相沉积工艺向沟槽内填充氧化硅,所述氧化硅填满所述沟槽且覆盖所述研磨停止层。本发明技术方案能够优化TEOS‑Ozone氧化硅薄膜的沉积速率、均匀性、致密性。
技术领域
本发明涉及半导体工艺领域,尤其涉及一种沟槽隔离结构的形成方法,以及一种优化的TEOS-Ozone热化学气相沉积工艺。
背景技术
在集成电路制造中,正硅酸乙酯-臭氧热化学气相沉积(TEOS(TetraethylOrthosilicate)-Ozone(O3)thermal CVD)工艺应用广泛,比如高深宽比(HARP,HighAspect Ration Process)沉积工艺、亚常压化学气相沉积(SACVD,Sub Atmospheric CVD)工艺由于填孔能力好被广泛用于浅沟槽结构(STI,Shallow Trench Isolation)以及金属前介质层(PMD,Pre Metal Dielectric)的沟槽填充。
在进行TEOS-Ozone热化学气相沉积工艺时,基底表面的物理化学性质会影响TEOS-Ozone沉积氧化硅(SiO2)薄膜的沉积速率、均匀性、致密性等。研究表明,基底表面硅羟基(Si-OH)数量越多,越有利于TEOS-Ozone反应中间体的吸附,SiO2的沉积速率、均匀性、致密性则越好。以STI沟槽填充为例,当前工艺是在STI的SiO2沉积之前先采用原位蒸汽氧化反应工艺(ISSG,In Situ Steam Generation)或热氧化反应(Thermal)工艺制备一层氧化层,例如SiO2层,但ISSG或热氧化反应制备的SiO2层表面缺少硅羟基。
因此如何优化TEOS-Ozone热化学气相沉积工艺的沉积速率、均匀性及致密性,从而提高薄膜质量及产能成为目前亟待解决的问题。
发明内容
本发明技术方案要解决的技术问题是如何优化现有的TEOS-Ozone热化学气相沉积工艺的沉积速率、均匀性及致密性。
为解决上述技术问题,本发明技术方案提供一种沟槽隔离结构的形成方法,包括:提供半导体衬底,所述半导体衬底上形成有研磨停止层;依次刻蚀所述研磨停止层和半导体衬底,在所述研磨停止层和半导体衬底内形成沟槽;在所述半导体衬底内的沟槽侧壁及底部形成氧化硅层;采用紫外光以及含羟基的气态或液态物质对所述氧化硅层进行表面处理,或者,采用紫外光以及反应物组合对所述氧化硅层进行表面处理,所述反应物组合适于反应生成含羟基的物质;采用TEOS-Ozone热化学气相沉积工艺向所述沟槽内填充氧化硅,所述氧化硅填满所述沟槽且覆盖所述研磨停止层。
可选的,采用原位蒸汽氧化反应工艺或热氧化反应工艺在所述半导体衬底内的沟槽侧壁和底部形成氧化硅层。
可选的,所述含羟基的气态或液态物质包括H2O、H2O2或醇类。
可选的,所述反应物组合包括O3和H2或者包括O2和H2。
可选的,在采用紫外光进行表面处理时,还通入强氧化性物质。
可选的,所述强氧化性物质包括O3。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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